參數(shù)資料
型號： PIC18LF1330-I/SO
廠商： Microchip Technology
文件頁數(shù)： 168/318頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 4KX16 18SOIC
產(chǎn)品培訓模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標準包裝： 42
系列： PIC® 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 40MHz
連通性： UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 16
程序存儲器容量： 8KB（4K x 16）
程序存儲器類型： 閃存
EEPROM 大小： 128 x 8
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 18-SOIC（0.295"，7.50mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 642 (CN2011-ZH PDF)
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PIC18F1230/1330
2009 Microchip Technology Inc.
DS39758D-page 25
3.6.5.1
Compensating with the EUSART
An adjustment may be required when the EUSART
begins to generate framing errors or receives data with
errors while in Asynchronous mode. Framing errors
indicate that the device clock frequency is too high; to
adjust for this, decrement the value in OSCTUNE to
reduce the clock frequency. On the other hand, errors
in data may suggest that the clock speed is too low; to
compensate, increment OSCTUNE to increase the
clock frequency.
3.6.5.2
Compensating with the Timers
This technique compares device clock speed to some
reference clock. Two timers may be used; one timer is
clocked by the peripheral clock, while the other is
clocked by a fixed reference source, such as the
Timer1 oscillator.
Both timers are cleared, but the timer clocked by the
reference generates interrupts. When an interrupt
occurs, the internally clocked timer is read and both
timers are cleared. If the internally clocked timer value
is greater than expected, then the internal oscillator
block is running too fast. To adjust for this, decrement
the OSCTUNE register.
REGISTER 3-1:
OSCTUNE: OSCILLATOR TUNING REGISTER
R/W-0
R/W-0(1)
U-0
R/W-0
INTSRC
PLLEN(1)
—
TUN4
TUN3
TUN2
TUN1
TUN0
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 7
INTSRC:
Internal Oscillator Low-Frequency Source Select bit
1
= 31.25 kHz device clock derived from 8 MHz INTOSC source (divide-by-256 enabled)
0
= 31 kHz device clock derived directly from INTRC internal oscillator
bit 6
PLLEN:
Frequency Multiplier PLL for INTOSC Enable bit(1)
1
= PLL enabled for INTOSC (4 MHz and 8 MHz only)
0
= PLL disabled
bit 5
Unimplemented:
Read as ‘0’
bit 4-0
TUN4:TUN0:
Frequency Tuning bits
01111
= Maximum frequency
00001
00000
= Center frequency. Oscillator module is running at the calibrated frequency.
11111
10000
= Minimum frequency
Note 1:
Available only in certain oscillator configurations; otherwise, this bit is unavailable and reads as ‘0’. See
for details.
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