參數(shù)資料
型號： PIC18LF24J10-E/PT
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PQFP44
封裝： 10 X 10 MM, 1 MM HEIGHT, PLASTIC, TQFP-44
文件頁數(shù)： 54/358頁
文件大?。?/td> 5679K
代理商： PIC18LF24J10-E/PT
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2007 Microchip Technology Inc.
Preliminary
DS39682C-page 145
PIC18F45J10 FAMILY
15.0
MASTER SYNCHRONOUS
SERIAL PORT (MSSP)
MODULE
15.1
Master SSP (MSSP) Module
Overview
The Master Synchronous Serial Port (MSSP) module is
a serial interface, useful for communicating with other
peripheral or microcontroller devices. These peripheral
devices may be serial EEPROMs, shift registers,
display drivers, A/D converters, etc. The MSSP module
can operate in one of two modes:
Serial Peripheral Interface (SPI)
Inter-Integrated Circuit (I2C)
- Full Master mode
- Slave mode (with general address call)
The I2C interface supports the following modes in
hardware:
Master mode
Multi-Master mode
Slave mode
PIC18F24J10/25J10 (28-pin) devices have one MSSP
module designated as MSSP1. PIC18F44J10/45J10
(40/44-pin)
devices
have
two
MSSP
modules,
designated as MSSP1 and MSSP2. Each module
operates independently of the other.
15.2
Control Registers
Each MSSP module has three associated control
registers. These include a status register (SSPxSTAT)
and
two
control
registers
(SSPxCON1
and
SSPxCON2). The use of these registers and their indi-
vidual configuration bits differ significantly depending
on whether the MSSP module is operated in SPI or I2C
mode.
Additional details are provided under the individual
sections.
15.3
SPI Mode
The SPI mode allows 8 bits of data to be synchronously
transmitted and received simultaneously. All four
modes
of
SPI
are
supported.
To
accomplish
communication, typically three pins are used:
Serial Data Out (SDOx) – RC5/SDO1 or
RD2/PSP2/SDO2
Serial Data In (SDIx) – RC4/SDI1/SDA1 or
RD1/PSP1/SDI2/SDA2
Serial Clock (SCKx) – RC3/SCK1/SCL1 or
RD0/PSP0/SCK2/SCL2
Additionally, a fourth pin may be used when in a Slave
mode of operation:
Slave Select (SSx) – RA5/AN4/SS1/C2OUT or
RD3/PSP3/SS2
Figure 15-1 shows the block diagram of the MSSP
module when operating in SPI mode.
FIGURE 15-1:
MSSP BLOCK DIAGRAM
(SPI MODE)
Note:
Throughout this section, generic refer-
ences to an MSSP module in any of its
operating modes may be interpreted as
being equally applicable to MSSP1 or
MSSP2. Register names and module I/O
signals use the generic designator ‘x’ to
indicate the use of a numeral to distinguish
a
particular
module,
when
required.
Control bit names are not individuated.
Note:
In devices with more than one MSSP
module, it is very important to pay close
attention to SSPCON register names.
SSP1CON1
and
SSP1CON2
control
different operational aspects of the same
module,
while
SSP1CON1
and
SSP2CON1 control the same features for
two different modules.
(
)
Read
Write
Internal
Data Bus
SSPxSR reg
SSPM3:SSPM0
bit 0
Shift
Clock
SSx Control
Enable
Edge
Select
Clock Select
TMR2 Output
TOSC
Prescaler
4, 16, 64
2
Edge
Select
2
4
Data to TX/RX in SSPxSR
TRIS bit
2
SMP:CKE
RC5 or RD2
SSPxBUF reg
RC4 or RD1
RA5 or RD3
RC3 or RD0
Note: Only port I/O names are used in this diagram for
the sake of brevity. Refer to the text for a full list
of multiplexed functions.
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