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參數(shù)資料
| 型號(hào)： | PIC24F16KL402T-I/SS |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 175/260頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 16BIT 16KB FLASH 28-SSOP |
| 產(chǎn)品培訓(xùn)模塊： | Low Cost PIC24F KL Family Overview |
| 標(biāo)準(zhǔn)包裝： | 2,100 |
| 系列： | PIC® XLP™ 24F |
| 核心處理器： | PIC |
| 芯體尺寸： | 16-位 |
| 速度： | 32MHz |
| 連通性： | I²C，IrDA，LIN，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，HLVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 24 |
| 程序存儲(chǔ)器容量： | 16KB（5.5K x 24） |
| 程序存儲(chǔ)器類型： | 閃存 |
| EEPROM 大?。?/td> | 512 x 8 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 12x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 28-SSOP（0.209"，5.30mm 寬） |
| 包裝： | 帶卷 (TR) |
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CHAPTER 8 8-BIT TIMER/EVENT COUNTERS 2 TO 5
User’s Manual U15905EJ2V1UD
254
8.4.5
Operation as interval timer (16 bits)
The V850ES/SA2 and V850ES/SA3 are provided with a 16-bit register that can be used only during cascade
connection.
The 16-bit resolution timer/event counter mode is selected by setting the TMC34 and TMC54 bits of 8-bit timer
mode control registers 3 and 5 (TMC3 and TMC5) to 1.
8-bit timer/event counter n operates as an interval timer by repeatedly generating interrupts using the count value
preset in 16-bit timer compare registers 23 and 45 (CR23 and CR45) as the interval.
In the following description, TM2 and TM3 are used. Read TM2 and TM3 as TM4 and TM5 when using TM4 and
TM5.
Setting method (when TM2 and TM3 are connected in cascade)
<1>
Set each register.
TCL2 register:
Selects the count clock (t)
(The TCL3 register does not need to be set in cascade connection)
CR2 register:
Compare value (N) ... Lower 8 bits (settable from 00H to FFH)
CR3 register:
Compare value (N) ... Higher 8 bits (settable from 00H to FFH)
TMC2, TMC3 register: Selects the mode in which clear & start occurs on a match between TM23
register and CR23 register (
×: don’t care)
TMC2 register = 0000xx00B
TMC3 register = 0001xx00B
<2>
Set the TMCE3 bit of the TMC3 register to 1. Then set the TMCE2 bit of the TMC2 register to 1 to start
the count operation.
<3>
When the values of the TM23 register and CR23 register connected in cascade match, INTTM2 is
generated (the TM23 register is cleared to 0000H).
<4>
INTTM2 is then generated repeatedly at the same interval.
Interval time = (N + 1)
× t: N = 0000H to FFFFH
Cautions 1. To write using 8-bit access during cascade connection, set the TMCE3 bit to 1 at
operation start and then set the TMCE2 bit to 1. When operation is stopped, set the
TMCE2 bit to 0 and then set the TMCE3 bit to 0.
2. During cascade connection, TI2 input, TO2 output, and INTTM2 input are used while
TI3 input, TO3 output, and INTTM3 input are not, so set bits LVS3, LVR3, TMC31, and
TOE3 to 0.
3. Do not change the value of the CR23 register during timer operation.
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PDF描述 |
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參數(shù)描述 |
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