參數(shù)資料
型號： PIC24FJ64GA106-I/PT
廠商： Microchip Technology
文件頁數(shù)： 30/330頁
文件大小： 0K
描述： MCU PIC 64KB FLASH 64TQFP
特色產品： PIC24FJ/33FJ MCUs & dsPIC? DSCs
標準包裝： 119
系列： PIC® 24F
核心處理器： PIC
芯體尺寸： 16-位
速度： 32MHz
連通性： I²C，IrDA，LIN，SPI，UART/USART
外圍設備： 欠壓檢測/復位，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 53
程序存儲器容量： 64KB（22K x 24）
程序存儲器類型： 閃存
RAM 容量： 16K x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 3.6 V
數(shù)據(jù)轉換器： A/D 16x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-TQFP
包裝： 托盤
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2010 Microchip Technology Inc.
DS39905E-page 125
PIC24FJ256GA110 FAMILY
9.0
POWER-SAVING FEATURES
The PIC24FJ256GA110 family of devices provides the
ability to manage power consumption by selectively
managing clocking to the CPU and the peripherals. In
general, a lower clock frequency and a reduction in the
number of circuits being clocked constitutes lower
consumed power. All PIC24F devices manage power
consumption in four different ways:
Clock frequency
Instruction-based Sleep and Idle modes
Software controlled Doze mode
Selective peripheral control in software
Combinations of these methods can be used to
selectively tailor an application’s power consumption,
while still maintaining critical application features, such
as timing-sensitive communications.
9.1
Clock Frequency and Clock
Switching
PIC24F devices allow for a wide range of clock
frequencies to be selected under application control. If
the system clock configuration is not locked, users can
choose low-power or high-precision oscillators by simply
changing the NOSC bits. The process of changing a
system clock during operation, as well as limitations to
the process, are discussed in more detail in Section 8.0
9.2
Instruction-Based Power-Saving
Modes
PIC24F devices have two special power-saving modes
that are entered through the execution of a special
PWRSAV
instruction. Sleep mode stops clock operation
and halts all code execution; Idle mode halts the CPU
and code execution, but allows peripheral modules to
continue operation. The assembly syntax of the
PWRSAV
instruction is shown in Example 9-1.
Sleep and Idle modes can be exited as a result of an
enabled interrupt, WDT time-out or a device Reset.
When the device exits these modes, it is said to
“wake-up”.
9.2.1
SLEEP MODE
Sleep mode has these features:
The system clock source is shut down. If an
on-chip oscillator is used, it is turned off.
The device current consumption will be reduced
to a minimum provided that no I/O pin is sourcing
current.
The Fail-Safe Clock Monitor does not operate
during Sleep mode since the system clock source
is disabled.
The LPRC clock will continue to run in Sleep
mode if the WDT is enabled.
The WDT, if enabled, is automatically cleared
prior to entering Sleep mode.
Some device features or peripherals may
continue to operate in Sleep mode. This includes
items such as the input change notification on the
I/O ports, or peripherals that use an external clock
input. Any peripheral that requires the system
clock source for its operation will be disabled in
Sleep mode.
Additional power reductions can be achieved by
disabling the on-chip voltage regulator whenever Sleep
mode is invoked. This is done by clearing the PMSLP
bit (RCON<8>). Disabling the regulator adds an addi-
tional delay of about 190
s to the device wake-up
time. It is recommended that applications not using the
voltage regulator leave the PMSLP bit set. For addi-
tional details on the regulator and Sleep mode, see
The device will wake-up from Sleep mode on any of
these events:
On any interrupt source that is individually
enabled
On any form of device Reset
On a WDT time-out
On wake-up from Sleep, the processor will restart with
the same clock source that was active when Sleep
mode was entered.
EXAMPLE 9-1:
PWRSAV
INSTRUCTION SYNTAX
Note:
This data sheet summarizes the features of
this group of PIC24F devices. It is not
intended to be a comprehensive reference
source. For more information, refer to the
“PIC24F
Family
Reference
Manual”
,
Section 10. “Power-Saving Features”
(DS39698).
PWRSAV
#0
; Put the device into SLEEP mode
PWRSAV
#1
; Put the device into IDLE mode
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