參數(shù)資料
型號： PIC24FV32KA301-I/P
廠商： Microchip Technology
文件頁數(shù)： 115/352頁
文件大小： 0K
描述： MCU 32KB FLASH 2KB RAM 20-PDIP
標準包裝： 22
系列： PIC® XLP™ 24F
核心處理器： PIC
芯體尺寸： 16-位
速度： 32MHz
連通性： I²C，IrDA，LIN，SPI，UART/USART
外圍設備： 欠壓檢測/復位，HLVD，POR，PWM，WDT
輸入/輸出數(shù)： 17
程序存儲器容量： 32KB（11K x 24）
程序存儲器類型： 閃存
EEPROM 大小： 512 x 8
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據轉換器： A/D 12x12b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
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2011-2012 Microchip Technology Inc.
DS39995C-page 201
PIC24FV32KA304 FAMILY
20.1.3
DATA SHIFT DIRECTION
The LENDIAN bit (CRCCON1<3>) is used to control
the shift direction. By default, the CRC will shift data
through the engine, MSb first. Setting LENDIAN (= 1)
causes the CRC to shift data, LSb first. This setting
allows better integration with various communication
schemes and removes the overhead of reversing the
bit order in software. Note that this only changes the
direction of the data that is shifted into the engine. The
result of the CRC calculation will still be a normal CRC
result, not a reverse CRC result.
20.1.4
INTERRUPT OPERATION
The module generates an interrupt that is configurable
by the user for either of two conditions. If CRCISEL is
‘0’, an interrupt is generated when the VWORD<4:0>
bits make a transition from a value of ‘1’ to ‘0’. If
CRCISEL is ‘1’, an interrupt will be generated after the
CRC operation finishes and the module sets the
CRCGO bit to ‘0’. Manually setting CRCGO to ‘0’ will
not generate an interrupt.
20.1.5
TYPICAL OPERATION
To use the module for a typical CRC calculation:
1.
Set the CRCEN bit to enable the module.
2.
Configure the module for the desired operation:
a)
Program the desired polynomial using the
CRCXORL and CRCXORH registers, and
the PLEN<4:0> bits.
b)
Configure the data width and shift direction
using the DWIDTHx and LENDIAN bits.
c)
Select the desired interrupt mode using the
CRCISEL bit.
3.
Preload the FIFO by writing to the CRCDATL
and CRCDATH registers until the CRCFUL bit is
set or no data is left.
4.
Clear old results by writing 00h to CRCWDATL
and CRCWDATH. CRCWDAT can also be left
unchanged to resume a previously halted
calculation.
5.
Set the CRCGO bit to start calculation.
6.
Write the remaining data into the FIFO as space
becomes available.
7.
When the calculation completes, CRCGO is
automatically cleared. An interrupt will be
generated if CRCISEL = 1.
8.
Read CRCWDATL and CRCWDATH for the
result of the calculation.
20.2
Registers
There are eight registers associated with the module:
CRCCON1
CRCCON2
CRCXORL
CRCXORH
CRCDATL
CRCDATH
CRCWDATL
CRCWDATH
The CRCCON1 and CRCCON2 registers (Register 20-1
and Register 20-2) control the operation of the module,
and configure the various settings. The CRCXOR
registers (Register 20-3 and Register 20-4) select the
polynomial terms to be used in the CRC equation. The
CRCDAT and CRCWDAT registers are each register
pairs that serve as buffers for the double-word, input
data and CRC processed output, respectively.
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