參數(shù)資料
型號： PIC24HJ32GP202-I/SP
廠商： Microchip Technology
文件頁數(shù)： 192/289頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 32K 28DIP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
標準包裝： 15
系列： PIC® 24H
核心處理器： PIC
芯體尺寸： 16-位
速度： 40 MIP
連通性： I²C，IrDA，LIN，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 21
程序存儲器容量： 32KB（11K x 24）
程序存儲器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 10x10b/12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-DIP（0.300"，7.62mm）
包裝： 管件
產(chǎn)品目錄頁面： 648 (CN2011-ZH PDF)
配用： AC164337-ND - MODULE SOCKET FOR PM3 40DIP
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CHAPTER 7 16-BIT TIMER/EVENT COUNTER Q (TMQ)
User’s Manual U17716EJ2V0UD
270
When the TQnCE bit is set to 1, the value of the 16-bit counter is cleared from FFFFH to 0000H in synchronization
with the count clock, and the counter starts counting. At this time, the output of the TOQn0 pin is inverted. Additionally,
the set value of the TQnCCR0 register is transferred to the CCR0 buffer register.
When the count value of the 16-bit counter matches the value of the CCR0 buffer register, the 16-bit counter is
cleared to 0000H, the output of the TOQn0 pin is inverted, and a compare match interrupt request signal
(INTTQnCC0) is generated.
The interval can be calculated by the following expression.
Interval = (Set value of TQnCCR0 register + 1)
× Count clock cycle
Remark
n = 0, 1
Figure 7-10. Register Setting for Interval Timer Mode Operation (1/3)
(a) TMQn control register 0 (TQnCTL0)
0/1
0
TQnCTL0
Select count clock
0: Stop counting
1: Enable counting
0/1
TQnCKS2 TQnCKS1 TQnCKS0
TQnCE
(b) TMQn control register 1 (TQnCTL1)
0
0/1
Note
00
TQnCTL1
0, 0, 0:
Interval timer mode
00
0
TQnMD2 TQnMD1 TQnMD0
TQ0EEE
TQ0EST
0: Operate on count
clock selected by
TQ0CKS0 to TQ0CKS2 bits
1: Count with external
event count input signal
Note
Enable setting of the TQ0EEE bit to 1 only when timer output (TOQ00, TOQ0b) is used.
In this case, set the TQ0CCR0 and TQ0CCRb registers to the same value (b = 1 to 3).
<R>
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