參數(shù)資料
型號: PIC24HJ64GP210-I/PT
廠商: Microchip Technology
文件頁數(shù): 136/292頁
文件大?。?/td> 0K
描述: IC PIC MCU FLASH 64KB 100TQFP
產(chǎn)品培訓(xùn)模塊: PIC24 Introduction
Graphics LCD System and PIC24 Interface
Asynchronous Stimulus
標(biāo)準(zhǔn)包裝: 119
系列: PIC® 24H
核心處理器: PIC
芯體尺寸: 16-位
速度: 40 MIP
連通性: I²C,IrDA,LIN,SPI,UART/USART
外圍設(shè)備: 欠壓檢測/復(fù)位,DMA,POR,PWM,WDT
輸入/輸出數(shù): 85
程序存儲器容量: 64KB(22K x 24)
程序存儲器類型: 閃存
RAM 容量: 8K x 8
電壓 - 電源 (Vcc/Vdd): 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 32x10b/12b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 100-TQFP
包裝: 托盤
產(chǎn)品目錄頁面: 649 (CN2011-ZH PDF)
配用: 876-1004-ND - PIC24 BREAKOUT BOARD
AC164333-ND - MODULE SKT FOR PM3 100QFP
DM300024-ND - KIT DEMO DSPICDEM 1.1
MA240012-ND - MODULE PLUG-IN PIC24H 100QFP
DV164033-ND - KIT START EXPLORER 16 MPLAB ICD2
DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32
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PIC24HJXXXGPX06/X08/X10
DS70175H-page 218
2009 Microchip Technology Inc.
21.2
On-Chip Voltage Regulator
All of the PIC24HJXXXGPX06/X08/X10 devices power
their core digital logic at a nominal 2.5V. This may cre-
ate an issue for designs that are required to operate at
a higher typical voltage, such as 3.3V. To simplify sys-
tem
design,
all
devices
in
the
PIC24HJXXXGPX06/X08/X10 family incorporate an
on-chip regulator that allows the device to run its core
logic from VDD.
The regulator provides power to the core from the other
VDD pins. The regulator requires that a low-ESR (less
than 5 ohms) capacitor (such as tantalum or ceramic)
be connected to the VCAP/VDDCORE pin (Figure 21-1).
This helps to maintain the stability of the regulator. The
recommended value for the filter capacitor is provided
On a POR
, it takes approximately 20 μs for the on-chip
voltage regulator to generate an output voltage. During
this time, designated as TSTARTUP, code execution is
disabled. TSTARTUP is applied every time the device
resumes operation after any power-down.
FIGURE 21-1:
ON-CHIP VOLTAGE
REGULATOR(1)
CONNECTIONS
21.3
BOR: Brown-out Reset
The BOR (Brown-out Reset) module is based on an
internal voltage reference circuit that monitors the reg-
ulated voltage VCAP/VDDCORE. The main purpose of
the BOR module is to generate a device Reset when a
brown-out condition occurs. Brown-out conditions are
generally caused by glitches on the AC mains (i.e.,
missing portions of the AC cycle waveform due to bad
power transmission lines or voltage sags due to exces-
sive current draw when a large inductive load is turned
on).
A BOR will generate a Reset pulse which will reset the
device. The BOR will select the clock source, based on
the device Configuration bit values (FNOSC<2:0> and
POSCMD<1:0>). Furthermore, if an oscillator mode is
selected, the BOR will activate the Oscillator Start-up
Timer (OST). The system clock is held until OST
expires. If the PLL is used, then the clock will be held
until the LOCK bit (OSCCON<5>) is ‘1’.
Concurrently, the PWRT time-out (TPWRT) will be
applied before the internal Reset is released. If
TPWRT = 0 and a crystal oscillator is being used, then
a nominal delay of TFSCM = 100 is applied. The total
delay in this case is TFSCM.
The BOR Status bit (RCON<1>) will be set to indicate
that a BOR has occurred. The BOR circuit continues to
operate while in Sleep or Idle modes and will reset the
device should VDD fall below the BOR threshold volt-
age.
Note:
It is important for the low-ESR capacitor to
be placed as close as possible to the
VCAP/VDDCORE pin.
Note 1:
These are typical operating voltages. Refer to
Characteristics” for the full operating ranges
of VDD and VCAP/VDDCORE.
2:
It is important for the low-ESR capacitor to
be placed as close as possible to the
VCAP/VDDCORE pin.
VDD
VCAP/VDDCORE
VSS
PIC24H
3.3V
CEFC
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