SYSTEM CONTROL REGISTER MAP
參數(shù)資料
型號： PIC32MX130F064B-I/ML
廠商： Microchip Technology
文件頁數(shù)： 276/320頁
文件大?。?/td> 0K
描述： IC MCU 32BIT 64KB FLASH 28-QFN
標(biāo)準(zhǔn)包裝： 61
系列： PIC® 32MX
核心處理器： MIPS32? M4K?
芯體尺寸： 32-位
速度： 40MHz
連通性： I²C，IrDA，LIN，PMP，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，DMA，I²S，POR，PWM，WDT
輸入/輸出數(shù)： 21
程序存儲器容量： 64KB（64K x 8）
程序存儲器類型： 閃存
RAM 容量： 16K x 8
電壓 - 電源 (Vcc/Vdd)： 2.3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 10x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-VQFN 裸露焊盤
包裝： 管件
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2011-20
12
Micro
chip
Te
chnology
Inc.
Prelimina
ry
D
S
6
1168D-p
age
59
PIC32MX1XX/2XX
TABLE 4-16:
SYSTEM CONTROL REGISTER MAP(1)
V
irtual
Ad
dress
(BF80_
#)
Regi
ster
Nam
e
Bit
Range
Bits
Al
lReset
s
31/15
30/14
29/13
28/12
27/11
26/10
25/9
24/8
23/7
22/6
21/5
20/4
19/3
18/2
17/1
16/0
F000 OSCCON
31:16
—
PLLODIV<2:0>
FRCDIV<2:0>
—
SOSCRDY PBDIVRDY
PBDIV<1:0>
PLLMULT<2:0>
x1xx(2)
15:0
—
COSC<2:0>
—
NOSC<2:0>
CLKLOCK ULOCK(4)
SLOCK
SLPEN
CF
UFRCEN(4) SOSCEN
OSWEN xxxx(2)
F010 OSCTUN
31:16
—
0000
15:0
—
—TUN<5:0>
0000
F020 REFOCON
31:16
—
RODIV<14:0>
0000
15:0
ON
—SIDL
OE
RSLP
—
DIVSWEN ACTIVE
—
ROSEL<3:0>
0000
F030 REFOTRIM
31:16
ROTRIM<8:0>
—
0000
15:0
—
0000
0000 WDTCON
31:16
—
0000
15:0
ON
—
SWDTPS<4:0>
WDTWINEN WDTCLR 0000
F600
RCON
31:16
—
0000
15:0
—
CMR
VREGS
EXTR
SWR
—
WDTO
SLEEP
IDLE
BOR
POR
xxxx(2)
F610 RSWRST
31:16
—
0000
15:0
—
—SWRST
0000
F200 CFGCON
31:16
—
0000
15:0
—
—IOLOCK PMDLOCK
—
—JTAGEN
—
TDOEN
000B
F230 SYSKEY(3)
31:16
SYSKEY<31:0>
0000
15:0
0000
F240
PMD1
31:16
—
0000
15:0
—
—CVRMD
—
—CTMUMD
—
—AD1MD
0000
F250
PMD2
31:16
—
0000
15:0
—
CMP3MD
CMP2MD CMP1MD 0000
F260
PMD3
31:16
—
OC5MD
OC4MD
OC3MD
OC2MD
OC1MD
0000
15:0
—
IC5MD
IC4MD
IC3MD
IC2MD
IC1MD
0000
F270
PMD4
31:16
—
0000
15:0
—
T5MD
T4MD
T3MD
T2MD
T1MD
0000
F280
PMD5
31:16
—
USB1MD
—
I2C1MD
0000
15:0
—
SPI2MD SPI1MD
—
—U2MD
U1MD
0000
F290
PMD6
31:16
—
PMPMD
0000
15:0
—
—REFOMD RTCCMD 0000
Legend:
x = unknown value on Reset; — = unimplemented, read as ‘0’. Reset values are shown in hexadecimal.
Note
1:
With the exception of those noted, all registers in this table have corresponding CLR, SET and INV registers at their virtual addresses, plus offsets of 0x4, 0x8 and 0xC, respectively. See Section 11.2
2:
Reset values are dependent on the DEVCFGx Configuration bits and the type of reset.
3:
This register does not have associated CLR, SET, INV registers.
4:
This bit is available on PIC32MX2XX devices only.
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