RTCCON: RTC CONTROL REGISTER<" />
參數(shù)資料
型號： PIC32MX150F128D-I/PT
廠商： Microchip Technology
文件頁數(shù)： 106/320頁
文件大小： 0K
描述： IC MCU 32BIT 128KB FLASH 44-TQFP
標(biāo)準(zhǔn)包裝： 160
系列： PIC® 32MX
核心處理器： MIPS32? M4K?
芯體尺寸： 32-位
速度： 40MHz
連通性： I²C，IrDA，LIN，PMP，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，DMA，I²S，POR，PWM，WDT
輸入/輸出數(shù)： 34
程序存儲器容量： 128KB（128K x 8）
程序存儲器類型： 閃存
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 2.3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 13x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-TQFP
包裝： 托盤
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PIC32MX1XX/2XX
DS61168D-page 194
Preliminary
2011-2012 Microchip Technology Inc.
REGISTER 20-1:
RTCCON: RTC CONTROL REGISTER(1)
Bit
Range
Bit
31/23/15/7
Bit
30/22/14/6
Bit
29/21/13/5
Bit
28/20/12/4
Bit
27/19/11/3
Bit
26/18/10/2
Bit
25/17/9/1
Bit
24/16/8/0
31:24
U-0
R/W-0
—
—CAL<9:8>
23:16
R/W-0
CAL<7:0>
15:8
R/W-0
U-0
R/W-0
U-0
ON(2,3)
—SIDL
—
7:0
R/W-0
R-0
U-0
R/W-0
R-0
R/W-0
RTSECSEL(4) RTCCLKON
—
—RTCWREN(5) RTCSYNC HALFSEC(6)
RTCOE
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 31-26 Unimplemented: Read as ‘0’
bit 25-16 CAL<9:0>: RTC Drift Calibration bits, which contain a signed 10-bit integer value
0111111111 = Maximum positive adjustment, adds 511 RTC clock pulses every one minute
0000000001 = Minimum positive adjustment, adds 1 RTC clock pulse every one minute
0000000000 = No adjustment
1111111111 = Minimum negative adjustment, subtracts 1 RTC clock pulse every one minute
1000000000 = Minimum negative adjustment, subtracts 512 clock pulses every one minute
bit 15
ON: RTCC On bit(2,3)
1 = RTCC module is enabled
0 = RTCC module is disabled
bit 14
Unimplemented: Read as ‘0’
bit 13
SIDL: Stop in Idle Mode bit
1 = Disables the PBCLK to the RTCC when CPU enters in Idle mode
0 = Continue normal operation in Idle mode
bit 12-8
Unimplemented: Read as ‘0’
bit 7
RTSECSEL: RTCC Seconds Clock Output Select bit(4)
1 = RTCC Seconds Clock is selected for the RTCC pin
0 = RTCC Alarm Pulse is selected for the RTCC pin
bit 6
RTCCLKON: RTCC Clock Enable Status bit
1 = RTCC Clock is actively running
0 = RTCC Clock is not running
bit 5-4
Unimplemented: Read as ‘0’
Note 1: This register is reset only on a Power-on Reset (POR).
2: The ON bit is only writable when RTCWREN = 1.
3: When using the 1:1 PBCLK divisor, the user’s software should not read/write the peripheral’s SFRs in the
SYSCLK cycle immediately following the instruction that clears the module’s ON bit.
4: Requires RTCOE = 1 (RTCCON<0>) for the output to be active.
5: The RTCWREN bit can be set only when the write sequence is enabled.
6: This bit is read-only. It is cleared to ‘0’ on a write to the seconds bit fields (RTCTIME<14:8>).
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