Each decoupling capacitor must be p" />
參數(shù)資料
型號： PPC5605BCLQ48
廠商： Freescale Semiconductor
文件頁數(shù)： 66/112頁
文件大?。?/td> 0K
描述： MCU 32BIT 768K 48MHZ
標準包裝： 90
系列： MPC56xx Qorivva
核心處理器： e200z0h
芯體尺寸： 32-位
速度： 48MHz
連通性： CAN，I²C，LIN，SCI，SPI
外圍設備： POR，PWM，WDT
輸入/輸出數(shù)： 121
程序存儲器容量： 768KB（768K x 8）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 4K x 16
RAM 容量： 64K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉換器： A/D 15x10b，5x12b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 144-LQFP
包裝： 托盤
Electrical characteristics
MPC5607B Microcontroller Data Sheet, Rev. 7
Freescale Semiconductor
57
Each decoupling capacitor must be placed between each of the three VDD_LV/VSS_LV supply pairs to ensure stable voltage (see
Table 25. Voltage regulator electrical characteristics
Symbol
C
Parameter
Conditions1
1 V
DD = 3.3 V ± 10% / 5.0 V ± 10%, TA = 40 to 125 °C, unless otherwise specified
Value
Unit
Min
Typ
Max
CREGn
SR — Internal voltage regulator external
capacitance
—
200
—
500
nF
RREG
SR — Stability capacitor equivalent serial
resistance
Range:
10 kHz to 20 MHz
——
0.2
CDEC1
SR — Decoupling capacitance2 ballast
2 This capacitance value is driven by the constraints of the external voltage regulator supplying the V
DD_BV voltage. A
typical value is in the range of 470 nF.
VDD_BV/VSS_LV pair:
VDD_BV = 4.5 V to 5.5 V
1003
3 This value is acceptable to guarantee operation from 4.5 V to 5.5 V
4704
—nF
VDD_BV/VSS_LV pair:
VDD_BV = 3V to 3.6V
400
—
CDEC2
SR — Decoupling capacitance regulator
supply
VDD/VSS pair
10
100
—
nF
VMREG
CC T Main regulator output voltage
Before exiting from reset
—
1.32
—
V
P
After trimming
1.16
1.28
—
IMREG
SR — Main regulator current provided to
VDD_LV domain
——
—
150
mA
IMREGINT
CC D Main regulator module current
consumption
IMREG = 200 mA
—
2
mA
IMREG = 0 mA
—
1
VLPREG
CC P Low-power regulator output voltage
After trimming
1.16
1.28
—
V
ILPREG
SR — Low-power regulator current provided
to VDD_LV domain
——
—
15
mA
ILPREGINT
CC D Low-power regulator module current
consumption
ILPREG = 15 mA;
TA = 55 °C
——
600
A
—
ILPREG = 0 mA;
TA = 55 °C
—
5—
VULPREG
CC P Ultra low power regulator output
voltage
After trimming
1.16
1.28
—
V
IULPREG
SR — Ultra low power regulator current
provided to VDD_LV domain
——
—
5
mA
IULPREGINT CC D Ultra low power regulator module
current consumption
IULPREG = 5 mA;
TA = 55 °C
——
100
A
IULPREG = 0 mA;
TA = 55 °C
—
2—
IDD_BV
CC D In-rush average current on VDD_BV
during power-up5
——
—
3006
mA
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PDF描述
PPC5604BCLL48 MCU 32BIT 512K 48MHZ
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參數(shù)描述
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