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參數(shù)資料
| 型號(hào)： | PSD4135G3-A-12J |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | DIODE ZENER SINGLE 500mW 13Vz 9.5mA-Izt 0.05 0.5uA-Ir 9.9 SOD-123 3K/REEL |
| 中文描述： | Flash在系統(tǒng)可編程外設(shè)的16位微控制器 |
| 文件頁數(shù)： | 74/93頁 |
| 文件大?。?/td> | 503K |
| 代理商： | PSD4135G3-A-12J |
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Preliminary Information
PSD4000 Series
71
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
t
NLNH
Warm RESET Active Low Time (Note 1)
150
ns
t
OPR
RESET High to Operational Device
120
ns
t
NLNH-PO
Power On Reset Active Low Time
1
ms
t
NLNH-A
Warm RESET Active Low Time
(Note 2)
25
μs
Reset Pin Timing
(5 V ± 10%)
NOTE:
1. t
CLCL
is the CLKIN clock period.
Microcontroller Interface – PSD4000 AC/DC Parameters
(5V ±10% Versions)
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
t
BVBH
Vstby Detection to Vstbyon Output High
(Note 1)
20
μs
t
BXBL
VstbyOff Detection to Vstbyon
Output Low
(Note 1)
20
μs
V
stbyon
Timing
(5 V ± 10%)
-70
-90
Symbol
Parameter
Conditions
Min
Max
Min
Max
Unit
t
LVDV
ALE Access Time from
Power Down
80
90
ns
Maximum Delay from APD Enable
to Internal PDN Valid Signal
Using CLKIN Input
15
*
t
CLCL
(μs) (Note 1)
μs
t
CLWH
Power Down Timing
(5 V ± 10%)
NOTE:
1. RESET will not abort Flash programming/erase cycles.
2. RESET will abort Flash programming or erase cycle.
NOTE:
1. Vstbyon is measured at V
CC
ramp rate of 2 ms.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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