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參數(shù)資料
| 型號： | PSD413A2-20JI |
| 英文描述： | Field-Programmable Peripheral |
| 中文描述： | 現(xiàn)場可編程外圍 |
| 文件頁數(shù)： | 13/123頁 |
| 文件大?。?/td> | 657K |
| 代理商： | PSD413A2-20JI |
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PSD4XX Famly
10
9.0
The PSD4XX
Architecture
PSD4XX consists of five major functional blocks:
J
ZPLDBlocks
J
Bus Interface
J
I/OPorts
J
Memory Block
J
Power Management Unit
The functions of each block are described in the following sections. Many of the blocks
perform multiple functions, and are user configurable. The chip configurations are specified
by the user in the PSDsoft Development Software. Other configurations are specified by
setting up the appropriate bits in the configuration registers during run time.
9.1 The ZPLDBlock
The PSD4XX series devices provide two ZPLD configurations. The ZPLD in the
PSD4XXA1
devices has 8 registered macrocells, 8 combinatorial macrocells, and up to 113
product terms.
The
PSD4XXA2
has a full function ZPLD with 24 registered macrocells and up to 126
product terms.
9.1.1 The PSD4XXA1 ZPLDBlock
Key Features
J
2 Embedded ZPLD devices
J
8 registered and 8 combinatorial macrocells
J
Combinatorial/registered outputs
J
Maximum 113 product terms
J
Programmable output polarity
J
User configured register clear/preset
J
User configured register clock input
J
37 Inputs
J
Accessible via 16 I/O pins
J
Power Saving Mode
J
UV-Erasable
General Description
The ZPLD block has 2 embedded PLD devices:
J
DPLD
The Address Decoding PLD, generating select signals to internal I/O or memory blocks.
J
GPLD
The General Purpose PLD provides 8 registered and combinatorial programmable
macrocells for general or complex logic implementation; dedicated to user application.
Figure 4 shows the architecture of the ZPLD. The PLD devices all share the same input
bus. The true or complement of the 37 input signals are fed to the programmable
AND-ARRAY. Names and sources of the input signals are shown in Table 3. The PB
signals, depending on user configuration, can either be macrocell feedbacks or inputs from
Port B.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PSD413A2-20LI | Field-Programmable Peripheral |
| PSD413A2-20LM | 200V 100kRad Hi-Rel Single N-Channel TID Hardened MOSFET in a SMD-1 package; Similar to IRHN7250 with optional Total Dose Rating of 1000kRads |
| PSD413A2-20U | Field-Programmable Peripheral |
| PSD413A2-20UI | 200V 100kRad Hi-Rel Single N-Channel TID Hardened MOSFET in a SMD-1 package; JANS Certified version of the IRHN7250 |
| PSD413A2-70J | 200V 100kRad Hi-Rel Single N-Channel TID Hardened MOSFET in a SMD-2 package. Also available in 300kRads.; Similar to IRHNA67260 with optional Total Dose Rating of 300kRads |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PSD413A2-C-70L | 制造商:WSI 功能描述: |
| PSD4-16 | 制造商:Tamura Corporation of America 功能描述: |
| PSD4-20 | 制造商:MICROTRAN 功能描述:POWER TRANSFORMER, 6 VA |
| PSD4235G2-70U | 功能描述:SPLD - 簡單可編程邏輯器件 5.0V 4M 70ns RoHS:否 制造商:Texas Instruments 邏輯系列:TICPAL22V10Z 大電池?cái)?shù)量:10 最大工作頻率:66 MHz 延遲時(shí)間:25 ns 工作電源電壓:4.75 V to 5.25 V 電源電流:100 uA 最大工作溫度:+ 75 C 最小工作溫度:0 C 安裝風(fēng)格:Through Hole 封裝 / 箱體:DIP-24 |
| PSD4235G2-90U | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 5.0V 4M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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