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參數(shù)資料
| 型號(hào)： | PSD813F2-12JI |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Flash In-System Programmable ISP Peripherals For 8-bit MCUs |
| 中文描述： | Flash在系統(tǒng)可編程ISP的外設(shè)的8位微控制器 |
| 文件頁(yè)數(shù)： | 86/110頁(yè) |
| 文件大小： | 1685K |
| 代理商： | PSD813F2-12JI |
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PSD813F1
86/110
Table 52. CPLD Macrocell Asynchronous Clock Mode Timing (3V devices)
Note: 1. ZPSD Versions only.
Symbol
Parameter
Conditions
-15
-20
PT
Aloc
Turbo
Off
1
Slew
Rate
Unit
Min
Max
Min
Max
f
MAXA
Maximum Frequency
External Feedback
1/(t
SA
+t
COA
)
19.2
16.9
MHz
Maximum Frequency
Internal Feedback
(f
CNTA
)
1/(t
SA
+t
COA
–
10)
23.8
20.4
MHz
Maximum Frequency
Pipelined Data
1/(t
CHA
+t
CLA
)
27
24.4
MHz
t
SA
Input Setup Time
12
13
+ 4
+ 20
ns
t
HA
Input Hold Time
15
17
ns
t
CHA
Clock High Time
22
25
+ 20
ns
t
CLA
Clock Low Time
15
16
+ 20
ns
t
COA
Clock to Output Delay
40
46
+ 20
–
6
ns
t
ARD
CPLD Array Delay
Any macrocell
29
33
+ 4
ns
t
MINA
Minimum Clock Period
1/f
CNTA
42
49
ns
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PDF描述 |
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參數(shù)描述 |
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