參數資料
型號： PSD834F2V-12
廠商： 意法半導體
英文描述： Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 5V
中文描述： Flash在系統(tǒng)可編程（ISP）的周邊8位MCU，5V的
文件頁數： 84/110頁
文件大小： 1737K
代理商： PSD834F2V-12
PSD813F2, PSD833F2, PSD834F2, PSD853F2, PSD854F2
84/110
Table 51. CPLD Macrocell Asynchronous Clock Mode Timing (5V devices)
Symbol
Parameter
Conditions
-70
-90
-15
PT
Aloc
Turbo
Off
Slew
Rate
Unit
Min
Max
Min
Max
Min
Max
f
MAXA
Maximum
Frequency
External
Feedback
1/(t
SA
+t
COA
)
38.4
26.32
21.27
MHz
Maximum
Frequency
Internal
Feedback
(f
CNTA
)
1/(t
SA
+t
COA
–10)
62.5
35.71
27.78
MHz
Maximum
Frequency
Pipelined
Data
1/(t
CHA
+t
CLA
)
71.4
41.67
35.71
MHz
t
SA
Input Setup
Time
7
8
12
+ 2
+ 10
ns
t
HA
Input Hold
Time
8
12
14
ns
t
CHA
Clock Input
High Time
9
12
15
+ 10
ns
t
CLA
Clock Input
Low Time
9
12
15
+ 10
ns
t
COA
Clock to
Output Delay
21
30
37
+ 10
– 2
ns
t
ARDA
CPLD Array
Delay
Any macrocell
11
16
22
+ 2
ns
t
MINA
Minimum
Clock Period
1/f
CNTA
16
28
39
ns
相關PDF資料
PDF描述
PSD854F2V-12 CONN HEADER 28POS .100 STR GOLD
PSD834F5V-70 Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 5V
PSD854F5V-70 Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 5V
PSD814F5V-90 Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 5V
PSD834F5V-90 Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 5V
相關代理商/技術參數
參數描述
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PSD834F2V-20JI 功能描述:CPLD - 復雜可編程邏輯器件 3.0V 2M 200ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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