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參數(shù)資料
| 型號： | PSD835F1-B-70J |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Configurable Memory System on a Chip for 8-Bit Microcontrollers |
| 中文描述： | 在8片位微控制器可配置存儲系統(tǒng) |
| 文件頁數(shù)： | 88/110頁 |
| 文件大?。?/td> | 570K |
| 代理商： | PSD835F1-B-70J |
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PSD835G2
PSD8XX Family
87
PSD835G2 AC/DC Parameters – CPLD Timing Parameters
(3.0 V to 3.6 V Versions)
-90
-12
Slew
Rate
(Note 1)
Unit
PT
Aloc
TURBO
OFF
Symbol
Parameter
Conditions
Min
Max
Min
Max
GPLD Input Pin/Feedback to
GPLD Combinatorial Output
t
PD
38
43
Add 4 Add 20 Sub 6
ns
t
EA
GPLD Input to GPLD Output
Enable
43
45
Add 20 Sub 6
ns
t
ER
GPLD Input to GPLD Output
Disable
43
45
Add 20 Sub 6
ns
t
ARP
GPLD Register Clear or
Preset Delay
38
43
Add 20 Sub 6
ns
t
ARPW
GPLD Register Clear or
Preset Pulse Width
28
30
Add 20
ns
t
ARD
GPLD Array Delay
Any Micro
Cell
23
27
Add 4
ns
GPLD Combinatorial Timing
(3.0 V to 3.6 V Versions)
-90
-12
Slew
Rate
(Note 1)
Unit
PT
Aloc
TURBO
OFF
Symbol
Parameter
Conditions
Min
Max
Min
Max
Maximum Frequency
External Feedback
Maximum Frequency
Internal Feedback (f
CNT
)
Maximum Frequency
Pipelined Data
Input Setup Time
Input Hold Time
Clock High Time
Clock Low Time
Clock to Output Delay
GPLD Array Delay
Minimum Clock Period
1/(t
S
+t
CO
)
24.3
20.4
MHz
f
MAX
1/(t
S
+t
CO
–10)
32.2
25.6
MHz
1/(t
CH
+t
CL
)
45.0
35.7
MHz
t
S
t
H
t
CH
t
CL
t
CO
t
ARD
t
MIN
18
0
11
11
23
0
14
14
Add 4 Add 20
ns
ns
ns
ns
ns
ns
ns
Clock Input
Clock Input
Clock Input
Any Micro
Cell
t
CH
+t
CL
(Note 2)
23
23
26
27
Sub 6
Add 4
22
28
GPLD Micro
Cell Synchronous Clock Mode Timing
(3.0 V to 3.6 V Versions)
NOTES:
1. Fast Slew Rate output available on Port C and F.
2. CLKIN t
CLCL
= t
CH
+ t
CL
.
NOTE:
1. Fast Slew Rate output available on Port C and F.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PSD835F1-B-70JI | Configurable Memory System on a Chip for 8-Bit Microcontrollers |
| PSD835F1-B-70M | Configurable Memory System on a Chip for 8-Bit Microcontrollers |
| PSD835F1-B-70MI | Configurable Memory System on a Chip for 8-Bit Microcontrollers |
| PSD835F1-B-70U | Configurable Memory System on a Chip for 8-Bit Microcontrollers |
| PSD835F1-B-70UI | Configurable Memory System on a Chip for 8-Bit Microcontrollers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PSD835G2-70U | 功能描述:靜態(tài)隨機存取存儲器 5.0V 4M 70ns RoHS:否 制造商:Cypress Semiconductor 存儲容量:16 Mbit 組織:1 M x 16 訪問時間:55 ns 電源電壓-最大:3.6 V 電源電壓-最小:2.2 V 最大工作電流:22 uA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:TSOP-48 封裝:Tray |
| PSD835G2-90U | 功能描述:靜態(tài)隨機存取存儲器 5.0V 4M 90ns RoHS:否 制造商:Cypress Semiconductor 存儲容量:16 Mbit 組織:1 M x 16 訪問時間:55 ns 電源電壓-最大:3.6 V 電源電壓-最小:2.2 V 最大工作電流:22 uA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:TSOP-48 封裝:Tray |
| PSD835G2-90UI | 功能描述:靜態(tài)隨機存取存儲器 5.0V 4M 90ns RoHS:否 制造商:Cypress Semiconductor 存儲容量:16 Mbit 組織:1 M x 16 訪問時間:55 ns 電源電壓-最大:3.6 V 電源電壓-最小:2.2 V 最大工作電流:22 uA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:TSOP-48 封裝:Tray |
| PSD835G2V-12UI | 功能描述:靜態(tài)隨機存取存儲器 3.0V 4M 120ns RoHS:否 制造商:Cypress Semiconductor 存儲容量:16 Mbit 組織:1 M x 16 訪問時間:55 ns 電源電壓-最大:3.6 V 電源電壓-最小:2.2 V 最大工作電流:22 uA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:TSOP-48 封裝:Tray |
| PSD835G2V-90U | 功能描述:靜態(tài)隨機存取存儲器 3.0V 4M 90ns RoHS:否 制造商:Cypress Semiconductor 存儲容量:16 Mbit 組織:1 M x 16 訪問時間:55 ns 電源電壓-最大:3.6 V 電源電壓-最小:2.2 V 最大工作電流:22 uA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:TSOP-48 封裝:Tray |
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