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  • 參數(shù)資料
    型號(hào): PSP211
    英文描述: -100V Single P-Channel Hi-Rel MOSFET in a TO-205AF package; A JANTX2N6849 with Standard Packaging
    中文描述: 模擬IC
    文件頁數(shù): 91/317頁
    文件大?。?/td> 3334K
    代理商: PSP211
    第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁當(dāng)前第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁第311頁第312頁第313頁第314頁第315頁第316頁第317頁
    PSB 2115
    PSF 2115
    Functional Description
    Semiconductor Group
    91
    11.97
    TE and LT-T
    In TE/LT-T applications, the transmit and receive bit clocks are derived, with the help of
    the DPLL, from the S interface receive data stream. The received signal is sampled
    several times inside the derived receive clock period, and a majority logic is used to
    additionally reduce bit error rate in severe conditions (
    see chapter 2.5.3
    ). The transmit
    frame is shifted by two bits with respect to the received frame.
    In TE mode the output clocks (DCL, FSC etc.) are synchronous to the S interface timing.
    In LT-T mode the IPAC provides a 1.536 MHz clock on the SCLK pin synchronous to the
    S interface. This can be used as the reference clock for an external PLL which provides
    the FSC and DCL clocks. Since the IPAC provides different dividers, the clocks can also
    be generated internally from the DCL input connected to SCLK (see
    chapter 2.8.2.2
    ).
    Figure 33
    Clock System of the IPAC in TE and LT-T Modes
    ITS09634
    DCL
    FSC
    SCLK
    PLL
    LT-T Mode
    Slip
    Detector
    (PLL)
    "NT2" Clock
    Generator
    Reference
    Clock
    DCL
    FSC
    BCL
    PLL
    TE Mode
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    PDF描述
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    P-SP228 制造商:Pentair Technical Products / Hoffman 功能描述:Swing Panel, 800x2200mm
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