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參數(shù)資料
| 型號： | QL1P100-7PU86I |
| 廠商： | QUICKLOGIC CORP |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 640 CLBS, 100000 GATES, PBGA86 |
| 封裝： | 6 X 6 MM, 1.20 MMHEIGHT, 0.50 MM PITCH, TFBGA-86 |
| 文件頁數(shù)： | 24/44頁 |
| 文件大?。?/td> | 1101K |
| 代理商： | QL1P100-7PU86I |
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2010 QuickLogic Corporation
QuickLogic PolarPro Device Data Sheet — 86-Pin TFBGA QL1P100
30
Figure 26: FIFO POP Timing
Table 30: FIFO POP Timing
Symbol
Parameter
Commercial
Industrial
Min.
Max.
Min.
Max.
tSPOPEN
POP setup time to Pop_Clk: time POP must be stable
before the active edge of the FIFO Pop clock
1.01 ns
1.13 ns
1.19 ns
1.32 ns
tHPOPEN
POP hold time to Pop_Clk: time POP must be stable after
the active edge of the FIFO Pop clock
0 ns
tSPOPFLUSH
FLUSH setup time to Pop_Clk: time Fifo_Pop_Flush
must be stable before the active edge of the FIFO Pop
clock
1.11 ns
1.74 ns
1.43 ns
2.21 ns
tHPOPFLUSH
FLUSH hold time to Pop_Clk: time Fifo_Pop_Flush must
be stable after the active edge of the FIFO Pop clock
0 ns
tFPOP
Pop_Clk to Pop: Clock-to-out from the active FIFO
CLOCK edge and the time when the data is popped from
the FIFO at DOUT
2.32 ns
5.61 ns
2.37 ns
5.88 ns
t
COAE
Clock-to-out of Almost Empty
2.64 ns
3.58 ns
2.70 ns
3.66 ns
t
COPOPFLAG
Clock-to-out of FIFO Pop level indicator
2.32 ns
3.93 ns
2.38 ns
4.03 ns
Pop_Clk
DOUT[x:0]
POP
POP_FLAG
new status
old status
Fifo_Pop_Flush
Almost_Empty
t
SPOPEN
t
HPOPEN
t
SPOP
FLUSH
t
HPOP
FLUSH
t
COPOP
t
COAE
t
COPOPFLAG
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| QL1P100-7PU86M | FPGA, 640 CLBS, 100000 GATES, PBGA86 |
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| QL1P100-7PUN86M | FPGA, 640 CLBS, 100000 GATES, PBGA86 |
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參數(shù)描述 |
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