參數(shù)資料
型號(hào)： QLUM3308-PT280C
英文描述： Telecommunication IC
中文描述： 通信集成電路
文件頁(yè)數(shù)： 16/22頁(yè)
文件大?。?/td> 200K
代理商： QLUM3308-PT280C
16
www.quicklogic.com
2001 QuickLogic Corporation
QLUM3216-PQ208C Device Data Sheet
8.0 Core Management and Error Handling
On Ingress, the Utopia Master Blocks are designed to handle and report Utopia errors such
as Parity error or wrong cell length. Errored cells are discarded with an error status
provided on pins for use by external management facilities.
The error handling only applies to the corresponding receive parts of the core
(i.e. Ingress Ports).
When an errored cell is received on the Utopia interface, the Core discards the complete
cell and provides a cell discard indication (Signal eg_err asserted)
1
together with a cell
discard status (Signal eg_err_stat(n)(m:0))
2
.
NOTE:
eg_err is routed to the corresponding wrx_err and erx_err respectively (see Figure 4).
Figure 15: Cell Discard Indication
The signals are sampled on the corresponding clocks from the west interface:
erx_... sampled with wtxclk (west transmit clock)
wrx_... sampled with wrxclk (west receive clock)
Table 9: Error Status Word Bit Coding
Error Status Bit
Name
Description
0
PARITY_ERR
Valid when wrx/erx_err is asserted. If set to one indicates that a cell is discarded
with a parity error decoded by the Core.
1
LENGTH_ER
Valid when wrx/erx_err is asserted. If set to one indicates that a cell is discarded
with a cell length error detected on the Utopia interface.
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PDF描述
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