參數(shù)資料
型號(hào)： QLUM3309-PT280C
英文描述： Telecommunication IC
中文描述： 通信集成電路
文件頁(yè)數(shù)： 10/22頁(yè)
文件大?。?/td> 200K
代理商： QLUM3309-PT280C
10
www.quicklogic.com
2001 QuickLogic Corporation
QLUM3216-PQ208C Device Data Sheet
7.0 Functional Description - Utopia Interface
The Utopia Bridge operates in single PHY mode. Therefore no address bus and only a
single status pin (clav[0]) per direction is used on the interfaces.
7.1 Utopia Level 2 Interface Single PHY Transmit Interface
The Transmit interface is controlled by the Master (usually ATM layer).
The transmit interface has data flowing in the same direction as the Master's enable
ut_txenb
. The Master transmit block generates all output signals on the rising edge of
the
ut_txclk
.
Transmit data is transferred from the Master to Slave via the following procedure. The
Slave indicates it can accept data using the
ut_txclav
(Mapped to ut_txfull in Octet level
transfer mode) signal, then the Master drives data onto
ut_txdat
and asserts
ut_txenb
.
The Slave controls the flow of data via the
ut_txclav
signal.
7.1.1 Cell Level Transfer - Single Cell
The Slave asserts
ut_txclav
1
when it is capable of accepting the transfer of a whole
cell. The Master asserts
ut_txenb
(Low) to indicate that it drives valid data to the Slave
2
. Together with the first word of a cell, the Master asserts
ut_txsoc
for one clock
cycle
3
.
To ensure that the Master does not cause transmit overrun, the Slave must de-assert
ut_txclav
at least 4 cycles before the end of a cell if it cannot accept the immediate
transfer of the subsequent cell
4
.
The Master can pause the cell transfer by de-asserting
ut_txenb
5
. To complete the
transfer to the Slave, the Master de-asserts
ut_txenb
6
.
Figure 6: Single Cell Transfer - Cell Level Transfer
相關(guān)PDF資料
PDF描述
QLUM3316-PQ208C Telecommunication IC
QLUM3316-PQ280C Telecommunication IC
QLUM3317-PQ208C Telecommunication IC
QLUM3317-PQ280C Telecommunication IC
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