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參數(shù)資料
| 型號： | QLUM3316-PQ208C |
| 英文描述： | Telecommunication IC |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 14/22頁 |
| 文件大小： | 200K |
| 代理商： | QLUM3316-PQ208C |
14
www.quicklogic.com
2001 QuickLogic Corporation
QLUM3216-PQ208C Device Data Sheet
To complete the cell transfer, the Core de-asserts the Utopia enable signal
ut_txenb
5
.
Figure 11: Single Cell Transfer - Cell Level Transfer
7.3.2 Back to Back Cells Transfer
When, during a cell transfer, the Slave is able to receive a subsequent cell, the Core keeps
ut_txenb
asserted between two cells
1
and asserts
ut_txsoc
, to start a new cell
transfer, immediately after the last word of the previous cell
2
.
Figure 12: Back to Back Cell Transfer
7.4 Utopia Level 3 Interface Single PHY Receive Interface
The Receive interface is controlled by the Master interface. The receive interface has data
flowing in the opposite direction to the Master's enable
ut_rxenb
.
Receive data is transferred from the Slave to the Master via the following procedure. The
Slave indicates it has valid data, then the Master asserts
ut_rxenb
to read this data from
the Slave. The Master indicates valid data (thereby controlling the data flow) via the
ut_rxclav
signal.
When a cell transfer is initiated, the transfer cannot be paused by the Master or the Slave.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| QLUM3316-PQ280C | Telecommunication IC |
| QLUM3317-PQ208C | Telecommunication IC |
| QLUM3317-PQ280C | Telecommunication IC |
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參數(shù)描述 |
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