參數(shù)資料
型號: QLUS3308-PT280C
英文描述: Telecommunication IC
中文描述: 通信集成電路
文件頁數(shù): 13/22頁
文件大小: 198K
代理商: QLUS3308-PT280C
QLUS3216-PQ208C Device Data Sheet
13
QLUS3216-PQ208C Device Data Sheet
7.3 Utopia Level 3 Interface Single PHY Transmit Interface
The Transmit interface is controlled by the Master.
The transmit interface has data flowing in the same direction as the ATM enable
ut_txenb
. The ATM transmit block generates all output signals on the rising edge of the
ut_txclk
.
Transmit data is transferred from the Master to PHY layer via the following procedure. The
Core indicates it can accept data using the
ut_txclav
signal, then the Master drives data
onto
ut_txdat
and asserts
ut_txenb
.
Once a cell transfer has started, the Master or the Slave device cannot pause the transfer
by any mean.
7.3.1 Single Cell Transfer
The Slave asserts
ut_txclav
1
when it is capable of accepting the transfer of a whole
cell. The Master asserts
ut_txenb
(Low) to indicate that it drives valid data to the Slave
2
. Together with the first octet of a cell, the Master asserts
ut_txsoc
for one clock
cycle
3
.
To ensure that the Master does not cause transmit overrun, the Slave de-asserts
ut_txclav
when
ut_txsoc
is de-asserted by the Master
4
.
When a cell transfer is initiated, the Master or the Slave cannot pause the transfer by any
means.
To complete the cell transfer, the Master de-asserts the Utopia enable signal
ut_txenb
5
.
Figure 10: Single Cell Transfer
相關(guān)PDF資料
PDF描述
QLUS3309-PQ208C Telecommunication IC
QLUS3309-PT280C Telecommunication IC
QLUS3316-PQ208C Telecommunication IC
QLUS3316-PT280C Telecommunication IC
QLUS3317-PQ208C Telecommunication IC
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參數(shù)描述
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