參數資料
型號: R5F101JLAFA#V0
廠商: Renesas Electronics America
文件頁數: 275/395頁
文件大?。?/td> 0K
描述: MCU 16BIT 512KB FLASH 52LQFP
產品培訓模塊: RL78 ADC
標準包裝: 1
系列: RL78/G13
核心處理器: RL78
芯體尺寸: 16-位
速度: 32MHz
連通性: CSI,I²C,LIN,UART/USART
外圍設備: DMA,POR,PWM,WDT
輸入/輸出數: 38
程序存儲器容量: 512KB(512K x 8)
程序存儲器類型: 閃存
RAM 容量: 32K x 8
電壓 - 電源 (Vcc/Vdd): 1.65 V ~ 5.5 V
數據轉換器: A/D 12x8/10b
振蕩器型: 內部
工作溫度: -40°C ~ 85°C
封裝/外殼: 52-LQFP
包裝: 托盤
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2005 Microchip Technology Inc.
DS39612B-page 345
PIC18F6525/6621/8525/8621
FIGURE 27-14:
EXAMPLE SPI MASTER MODE TIMING (CKE = 0)
TABLE 27-15: EXAMPLE SPI MODE REQUIREMENTS (MASTER MODE, CKE = 0)
SS
SCK
(CKP = 0)
SCK
(CKP = 1)
SDO
SDI
70
71
72
73
74
75, 76
78
79
80
79
78
MSb
LSb
bit 6 - - - - - -1
MSb In
LSb In
bit 6 - - - -1
Note:
Refer to Figure 27-4 for load conditions.
Param.
No.
Symbol
Characteristic
Min
Max
Units
Conditions
70
TssL2scH,
TssL2scL
SS
↓ to SCK ↓ or SCK ↑ Input
TCY
—ns
71
TscH
SCK Input High Time
(Slave mode)
Continuous
1.25 TCY + 30
ns
71A
Single Byte
40
ns
(Note 1)
72
TscL
SCK Input Low Time
(Slave mode)
Continuous
1.25 TCY + 30
ns
72A
Single Byte
40
ns
(Note 1)
73
TdiV2scH,
TdiV2scL
Setup Time of SDI Data Input to SCK Edge
100
ns
73A
TB2B
Last Clock Edge of Byte 1 to the 1st Clock Edge of
Byte 2
1.5 TCY + 40
ns
(Note 2)
74
TscH2diL,
TscL2diL
Hold Time of SDI Data Input to SCK Edge
100
ns
75
TdoR
SDO Data Output Rise Time
PIC18F6X2X/8X2X
25
ns
PIC18LF6X2X/8X2X
45
ns
76
TdoF
SDO Data Output Fall Time
25
ns
78
TscR
SCK Output Rise Time
(Master mode)
PIC18F6X2X/8X2X
25
ns
PIC18LF6X2X/8X2X
45
ns
79
TscF
SCK Output Fall Time (Master mode)
25
ns
80
TscH2doV,
TscL2doV
SDO Data Output Valid after
SCK Edge
PIC18F6X2X/8X2X
50
ns
PIC18LF6X2X/8X2X
100
ns
Note 1:
Requires the use of Parameter #73A.
2:
Only if Parameter #71A and #72A are used.
相關PDF資料
PDF描述
87520-0010ALF 87520-0010A USB S/D RECEPT
R5F101JKAFA#V0 MCU 16BIT 384KB FLASH 52LQFP
R5F100BGANA#V0 MCU 16BIT 128KB FLASH 32WQFN
R5F100BCANA#V0 MCU 16BIT 32KB FLASH 32WQFN
R5F100BAANA#V0 MCU 16BIT 16KB FLASH 32WQFN
相關代理商/技術參數
參數描述
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