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參數(shù)資料
| 型號(hào)： | S9S08DN32F1MLH |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 188/356頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 8BIT 32KB FLASH 64LQFP |
| 產(chǎn)品培訓(xùn)模塊： | S08D 8-Bit Microcontroller |
| 標(biāo)準(zhǔn)包裝： | 160 |
| 系列： | S08 |
| 核心處理器： | S08 |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | I²C，LIN，SCI，SPI |
| 外圍設(shè)備： | LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 53 |
| 程序存儲(chǔ)器容量： | 32KB（32K x 8） |
| 程序存儲(chǔ)器類(lèi)型： | 閃存 |
| EEPROM 大小： | 1K x 8 |
| RAM 容量： | 1.5K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 16x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 64-LQFP |
| 包裝： | 托盤(pán) |
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Chapter 15 Timer/PWM Module (S08TPMV3)
MC9S08DN60 Series Data Sheet, Rev 3
268
Freescale Semiconductor
15.3
Register Denition
This section consists of register descriptions in address order.
15.3.1
TPM Status and Control Register (TPMxSC)
TPMxSC contains the overow status ag and control bits used to congure the interrupt enable, TPM
conguration, clock source, and prescale factor. These controls relate to all channels within this timer
module.
76543210
RTOF
TOIE
CPWMS
CLKSB
CLKSA
PS2
PS1
PS0
W0
Reset
00000000
Figure 15-7. TPM Status and Control Register (TPMxSC)
Table 15-2. TPMxSC Field Descriptions
Field
Description
7
TOF
Timer overow ag. This read/write ag is set when the TPM counter resets to 0x0000 after reaching the modulo
value programmed in the TPM counter modulo registers. Clear TOF by reading the TPM status and control
register when TOF is set and then writing a logic 0 to TOF. If another TPM overow occurs before the clearing
sequence is complete, the sequence is reset so TOF would remain set after the clear sequence was completed
for the earlier TOF. This is done so a TOF interrupt request cannot be lost during the clearing sequence for a
previous TOF. Reset clears TOF. Writing a logic 1 to TOF has no effect.
0 TPM counter has not reached modulo value or overow
1 TPM counter has overowed
6
TOIE
Timer overow interrupt enable. This read/write bit enables TPM overow interrupts. If TOIE is set, an interrupt is
generated when TOF equals one. Reset clears TOIE.
0 TOF interrupts inhibited (use for software polling)
1 TOF interrupts enabled
5
CPWMS
Center-aligned PWM select. When present, this read/write bit selects CPWM operating mode. By default, the
TPM operates in up-counting mode for input capture, output compare, and edge-aligned PWM functions. Setting
CPWMS recongures the TPM to operate in up/down counting mode for CPWM functions. Reset clears CPWMS.
0 All channels operate as input capture, output compare, or edge-aligned PWM mode as selected by the
MSnB:MSnA control bits in each channel’s status and control register.
1 All channels operate in center-aligned PWM mode.
4–3
CLKS[B:A]
Clock source selects. As shown in Table 15-3, this 2-bit eld is used to disable the TPM system or select one of
three clock sources to drive the counter prescaler. The xed system clock source is only meaningful in systems
with a PLL-based or FLL-based system clock. When there is no PLL or FLL, the xed-system clock source is the
same as the bus rate clock. The external source is synchronized to the bus clock by TPM module, and the xed
system clock source (when a PLL or FLL is present) is synchronized to the bus clock by an on-chip
synchronization circuit. When a PLL or FLL is present but not enabled, the xed-system clock source is the same
as the bus-rate clock.
2–0
PS[2:0]
Prescale factor select. This 3-bit eld selects one of 8 division factors for the TPM clock input as shown in
Table 15-4. This prescaler is located after any clock source synchronization or clock source selection so it affects
the clock source selected to drive the TPM system. The new prescale factor will affect the clock source on the
next system clock cycle after the new value is updated into the register bits.
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