t53
參數(shù)資料
型號(hào)： SAB-C161O-L25M HA
廠商： Infineon Technologies
文件頁(yè)數(shù)： 57/66頁(yè)
文件大?。?/td> 0K
描述： IC MICROCONTROLLER 16BIT MQFP80
標(biāo)準(zhǔn)包裝： 850
系列： C16xx
核心處理器： C166
芯體尺寸： 16-位
速度： 25MHz
連通性： EBI/EMI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 63
程序存儲(chǔ)器類型： ROMless
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 80-QFP
包裝： 帶卷 (TR)
其它名稱： B161OL25MHAXT
C161OL25MHABAUMA1
C161OL25MHABXUMA1
SABC161OL25MHAXT
SP000014268
C161K
C161O
Data Sheet
56
V2.0, 2001-01
Data float after RdCS
(with RW-delay)1)
t53 SR –
30 +
tF
–
2TCL - 20
+ 2
tA + tF
ns
Data float after RdCS
(no RW-delay)1)
t68 SR –
5 +
tF
–
TCL - 20
+ 2
tA + tF
ns
Address hold after
RdCS, WrCS
t55 CC -16 + tF –
-16 +
tF
–
ns
Data hold after WrCS
t57 CC 9 + tF
–
TCL - 16
+
tF
–
ns
1) RW-delay and t
A refer to the next following bus cycle (including an access to an on-chip X-Peripheral).
2) Read data are latched with the same clock edge that triggers the address change and the rising RD edge.
Therefore address changes before the end of RD have no impact on read cycles.
3) These parameters refer to the latched chip select signals (CSxL). The early chip select signals (CSxE) are
specified together with the address and signal BHE (see figures below).
Demultiplexed Bus (Reduced Supply Voltage Range) (cont’d)
(Operating Conditions apply)
ALE cycle time = 4 TCL + 2
tA + tC + tF (100 ns at 20 MHz CPU clock without waitstates)
Parameter
Symbol
Max. CPU Clock
= 20 MHz
Variable CPU Clock
1 / 2TCL = 1 to 20 MHz
Unit
min.
max.
min.
max.
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PDF描述
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參數(shù)描述
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SAB-C161O-LM HA 功能描述:16位微控制器 - MCU 16-BIT ROM/ROMLESS ASC SSC 2 kB RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時(shí)鐘頻率:24 MHz 程序存儲(chǔ)器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
SAB-C161O-LM3V 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:16-Bit Single-Chip Microcontroller
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