參數(shù)資料
型號(hào)： SC16C652BIB48,157
廠商： NXP Semiconductors
文件頁(yè)數(shù)： 5/21頁(yè)
文件大小： 0K
描述： IC ENCODER/DECODER IRDA 48LQFP
標(biāo)準(zhǔn)包裝： 1,250
特點(diǎn)： 2 通道
通道數(shù)： 2，DUART
FIFO's： 32 字節(jié)
電源電壓： 2.5V，3.3V，5V
帶自動(dòng)流量控制功能： 是
帶IrDA 編碼器/解碼器： 是
帶故障啟動(dòng)位檢測(cè)功能： 是
帶調(diào)制解調(diào)器控制功能： 是
帶CMOS： 是
安裝類(lèi)型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 托盤(pán)
其它名稱(chēng)： 935274409157
SC16C652BIB48
SC16C652BIB48-ND
SC16C652B_4
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 04 — 1 September 2005
13 of 43
Philips Semiconductors
SC16C652B
Dual UART with 32-byte FIFOs and IrDA encoder/decoder
MCR[2] (OP1). Loop-back test data is entered into the transmit holding register via the
user data bus interface, D[7:0]. The transmit UART serializes the data and passes the
serial data to the receive UART via the internal loop-back connection. The receive UART
converts the serial data back into parallel data that is then made available at the user data
interface D[7:0]. The user optionally compares the received data to the initial transmitted
data for verifying error-free operation of the UART TX/RX circuits.
In this mode, the receiver and transmitter interrupts are fully operational. The modem
control interrupts are also operational.
Fig 5.
Internal loop-back mode diagram
CTSA, CTSB
TRANSMIT
FIFO
REGISTERS
TXA, TXB
RECEIVE
SHIFT
REGISTER
RECEIVE
FIFO
REGISTERS
RXA, RXB
INTERCONNECT
B
US
LINES
AND
CONTR
OL
SIGNALS
SC16C652B
TRANSMIT
SHIFT
REGISTER
XTAL2
XTAL1
002aaa594
FLOW
CONTROL
LOGIC
DATA BUS
AND
CONTROL
LOGIC
REGISTER
SELECT
LOGIC
INTERRUPT
CONTROL
LOGIC
CLOCK AND
BAUD RATE
GENERATOR
MODEM
CONTROL
LOGIC
FLOW
CONTROL
LOGIC
RTSA, RTSB
DSRA, DSRB
DTRA, DTRB
RIA, RIB
(OP1A, OP1B)
CDA, CDB
(OP2A, OP2B)
MCR[4]
=
1
IR
ENCODER
IR
DECODER
INTA, INTB
TXRDYA, TXRDYB
RXRDYA, RXRDYB
D0 to D7
IOR
IOW
RESET
A0 to A2
CSA
CSB
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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