參數(shù)資料
型號： SC16C752BIB48,128
廠商： NXP Semiconductors
文件頁數(shù)： 46/47頁
文件大?。?/td> 0K
描述： IC DUAL UART 64BYTE 48LQFP
標(biāo)準(zhǔn)包裝： 2,000
通道數(shù)： 2，DUART
FIFO's： 64 字節(jié)
電源電壓： 2.5V，3.3V，5V
帶自動流量控制功能： 是
帶故障啟動位檢測功能： 是
帶調(diào)制解調(diào)器控制功能： 是
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 帶卷 (TR)
其它名稱： 935274411128
SC16C752BIB48-F
SC16C752BIB48-F-ND
SC16C752B
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Product data sheet
Rev. 6 — 30 November 2010
8 of 47
NXP Semiconductors
SC16C752B
5 V, 2.2 V and 2.5 V dual UART, 5 Mbit/s (max.), with 64-byte FIFOs
6.2.1 Auto-RTS
Auto-RTS data flow control originates in the receiver block (see Figure 1 “Block diagram”
on page 3). Figure 5 shows RTSn functional timing. The receiver FIFO trigger levels used
in auto-RTS are stored in the TCR. RTSn is active if the RX FIFO level is below the halt
trigger level in TCR[3:0]. When the receiver FIFO halt trigger level is reached, RTSn is
de-asserted. The sending device (e.g., another UART) may send an additional byte after
the trigger level is reached (assuming the sending UART has another byte to send)
because it may not recognize the de-assertion of RTSn until it has begun sending the
additional byte. RTSn is automatically reasserted once the receiver FIFO reaches the
resume trigger level programmed via TCR[7:4]. This re-assertion allows the sending
device to resume transmission.
Fig 4.
Auto flow control (auto-RTS and auto-CTS) example
RX
FIFO
FLOW
CONTROL
TX
FIFO
PARALLEL
TO SERIAL
TX
FIFO
RX
FIFO
UART 1
UART 2
D7 to D0
RXn
TXn
RTSn
CTSn
TXn
RXn
CTSn
RTSn
D7 to D0
002aaf905
SERIAL TO
PARALLEL
SERIAL TO
PARALLEL
FLOW
CONTROL
FLOW
CONTROL
FLOW
CONTROL
PARALLEL
TO SERIAL
N = receiver FIFO trigger level.
The two blocks in dashed lines cover the case where an additional byte is sent, as described in Section 6.2.1.
Fig 5.
RTS functional timing
Start
byte N
Start
byte N
+ 1
Start
Stop
RXn
RTSn
IOR
N
N+1
12
002aaf906
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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