參數(shù)資料
型號： SC16C752IB48,157
廠商： NXP Semiconductors
文件頁數(shù)： 11/47頁
文件大?。?/td> 0K
描述： IC DUAL UART 64BYTE 48LQFP
標(biāo)準(zhǔn)包裝： 1,250
通道數(shù)： 2，DUART
FIFO's： 64 字節(jié)
電源電壓： 2.5V，3.3V，5V
帶自動流量控制功能： 是
帶故障啟動位檢測功能： 是
帶調(diào)制解調(diào)器控制功能： 是
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 托盤
其它名稱： 935270055157
SC16C752IB48
SC16C752IB48-ND
Philips Semiconductors
SC16C752
Dual UART with 64-byte FIFO
Product data
Rev. 04 — 20 June 2003
19 of 47
9397 750 11635
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
Table 10 lists and describes the SC16C752 internal registers.
[1]
These registers are accessible only when LCR[7] = 0.
[2]
The shaded bits in the above table can only be modied if register bit EFR[4] is enabled, i.e., if enhanced functions are enabled.
Table 10:
SC16C752 internal registers
Shaded bits are only accessible when EFR[4] is set.
A2 A1 A0 Register Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Read/
Write
General Register Set[1]
0
RHR
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R
0
THR
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
W
001IER
0/CTS
interrupt
enable[2]
0/RTS
interrupt
enable[2]
0/X sleep
mode[2]
modem
status
interrupt
receive
line status
interrupt
THR
empty
interrupt
Rx data
available
interrupt
R/W
0
1
0
FCR
RX
trigger
level
(MSB)
RX trigger
level (LSB)
0/TX
trigger
level
(MSB)[2]
0/TX
trigger
level
(LSB)[2]
DMA
mode
select
TX FIFO
reset
RX FIFO
reset
FIFO
enable
W
0
1
0
IIR
FCR[0]
0/CTS,
RTS
0/Xoff
interrupt
priority
bit 2
interrupt
priority
bit 1
interrupt
priority
bit 0
interrupt
status
R
0
1
LCR
DLAB
break
control bit
set parity parity
type
select
parity
enable
number of
stop bits
word
length
bit 1
word
length
bit 0
R/W
100MCR
1
× or
1
×/4
clock
TCR and
TLR
enable
0/Xon
Any
0/enable
loop-back
IRQ
enable
OP
FIFO
ready
enable
RTS
DTR
R/W
1
0
1
LSR
0/error in
RX FIFO
THR and
TSR
empty
THR
empty
break
interrupt
framing
error
parity
error
overrun
error
data in
receiver
R
1
0
MSR
CD
RI
DSR
CTS
CD
RI
DSR
CTS
R
1
SPR
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
1
0
TCR
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
1
TLR
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
1
FIFO
Rdy
0
RX FIFO
B status
RX FIFO
A status
0
TX FIFO B
status
TX FIFO
A status
R
Special Register Set[3]
0
DLL
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
0
1
DLH
bit 15
bit 14
bit 13
bit 12
bit 11
bit 10
bit 9
bit 8
R/W
Enhanced Register Set[4]
0
1
0
EFR
Auto
CTS
Auto RTS
Special
character
detect
Enable
enhanced
functions
software
ow
control
bit 3
software
ow
control
bit 2
software
ow
control
bit 1
software
ow
control
bit 0
R/W
1
0
Xon1
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
1
0
1
Xon2
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
1
0
Xoff1
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
1
Xoff2
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R/W
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