參數(shù)資料
型號： SC16IS762IBS,151
廠商： NXP Semiconductors
文件頁數(shù)： 13/60頁
文件大小： 0K
描述： IC UART DUAL I2C/SPI 32-HVQFN
產(chǎn)品培訓(xùn)模塊： Bridge Solutions
Stand-Alone UARTs
I²C Bus Fundamentals
特色產(chǎn)品： NXP - I2C Interface
標(biāo)準(zhǔn)包裝： 490
特點： 低電流
通道數(shù)： 2，DUART
FIFO's： 64 字節(jié)
規(guī)程： RS232，RS485
電源電壓： 2.5V, 3.3V
帶自動流量控制功能： 是
帶故障啟動位檢測功能： 是
帶調(diào)制解調(diào)器控制功能： 是
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 32-HVQFN（5x5）
包裝： 托盤
產(chǎn)品目錄頁面： 828 (CN2011-ZH PDF)
配用： 568-4000-ND - DEMO BOARD SPI/I2C TO DUAL UART
568-3510-ND - DEMO BOARD SPI/I2C TO UART
其它名稱： 568-2240
935279293151
SC16IS762IBS-S
xxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxx x x x xxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxx xx xx xxxxx
xxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxx xxxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxx x x
xxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxx xxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxx
xxxxxxxxxxxxxxxxxxxxxxxxx xxxxxxxxxxxxxxxxxxxx xxx
S
C
16IS
752
_SC1
6IS7
62
A
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mer
s
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NX
P
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12.
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.
Prod
uct
dat
a
sh
eet
Rev
.
9
—
22
March
2012
20
of
6
0
NXP
Semiconductors
SC16IS752;
SC16IS762
D
u
al
UART
with
I 2
C-b
u
s/SPI
int
e
rf
ace
,
6
4
-b
yt
e
FIFOs
,IrDA
SIR
Table 10.
SC16IS752/SC16IS762 internal registers
Register
address
Register
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
R/W
General register set[1]
0x00
RHR
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R
0x00
THR
bit 7bit 6
bit 5bit 4bit 3
bit 2
bit 1bit 0W
0x01
IER
CTS interrupt
RTS interrupt
enable[2]
Xoff[2]
Sleep
mode[2]
modem status
interrupt
receive line
status
interrupt
THR empty
interrupt
RX data
available
interrupt
R/W
0x02
FCR
RX trigger
level (MSB)
RX trigger
level (LSB)
TX trigger
level (MSB)[2]
TX trigger
level (LSB)[2]
reserved[3]
TX FIFO
RX FIFO
FIFO enable
W
0x02
IIR[5]
FIFO enable
interrupt
priority bit 4[2]
interrupt
priority bit 3[2]
interrupt
priority bit 2
interrupt
priority bit 1
interrupt
priority bit 0
interrupt
status
R
0x03
LCR
divisor latch
enable
set break
set parity
even parity
parity enable
stop bit
word length
bit 1
word length
bit 0
R/W
0x04
MCR
clock
divisor[2]
IrDA mode
enable[2]
Xon Any[2]
loopback
enable
reserved[3]
TCR and TLR
enable[2]
RTS
DTR (IO5)
R/W
0x05
LSR
FIFO data
error
THR and
TSR empty
THR empty
break
interrupt
framing error
parity error
overrun error
data in
receiver
R
0x06
MSR
CD
RI
DSR
CTS
CD
RI
DSR
CTS
R
0x07
SPR
bit 7bit 6
bit 5bit 4bit 3
bit 2
bit 1bit 0R/W
0x06
bit 7bit 6
bit 5bit 4bit 3
bit 2
bit 1bit 0R/W
0x07
TLR[6]
bit 7bit 6
bit 5bit 4bit 3
bit 2
bit 1bit 0R/W
0x08
TXLVL
bit 7bit 6
bit 5bit 4bit 3
bit 2
bit 1bit 0R
0x09
RXLVL
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
R
0x0A
IODir[7]
bit 7bit 6
bit 5bit 4bit 3
bit 2
bit 1bit 0R/W
0x0B
IOState[7]
bit 7bit 6
bit 5bit 4bit 3
bit 2
bit 1bit 0R/W
0x0C
IOIntEna [7]
bit 7bit 6
bit 5bit 4bit 3
bit 2
bit 1bit 0R/W
0x0D
reserved[3]
reserved[3]
reserved[3]
0x0E
IOControl[7]
reserved[3]
UART
software reset
I/O[3:0] or
RIB, CDB,
DTRB, DSRB
I/O[7:4] or
RIA, CDA,
DTRA, DSRA
latch
R/W
0x0F
EFCR
IrDA mode
(slow/ fast)[8]
reserved[3]
auto RS-485
RTS output
inversion
auto RS-485
RTS direction
control
reserved[3]
transmitter
disable
receiver
disable
9-bit mode
enable
R/W
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PDF描述
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