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參數(shù)資料
| 型號： | SC2200UFH-266 |
| 廠商： | National Semiconductor Corporation |
| 元件分類： | 微處理器 |
| 英文描述： | Thin Client On a Chip |
| 中文描述： | 瘦客戶機片上 |
| 文件頁數(shù)： | 349/433頁 |
| 文件大?。?/td> | 3255K |
| 代理商： | SC2200UFH-266 |
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Revision 3.0
349
www.national.com
G
Video Processor Module
(Continued)
Offset 7Ch-7Fh
Alpha Window 2 Control Register (R/W)
Reset Value: 00000000h
31:18
17
Reserved
LOAD_ALPHA (Load Alpha Value). (Write Only)
When set to 1, this bit causes the Video Processor to load the alpha
value (in bits [7:0], ALPHA2_VAL) at the start of the next frame.
ALPHA2_WIN_EN (Alpha Window 2 Enable).
Enable bit for Alpha Window 2.
0: Disable Alpha Window 2.
1: Enable Alpha Window 2.
Note:
Valid only if video window is enabled (F4BAR0+Memory Offset 00h[0] = 1).
ALPHA2_INCR (Alpha Window 2 Increment).
Specifies the alpha value increment/decrement.
This is a signed 8-bit value that is added to the alpha value for each frame. The MSB (bit 15) indicates the sign (i.e., incre-
ment or decrement). When this value reaches either the maximum or the minimum alpha value (255 or 0) it keeps that value
(i.e., it is not incremented/decremented) until it is reloaded via bit 17 (LOAD_ALPHA).
ALPHA2_VAL (Alpha Window 1 Value).
Specifies the alpha value to be used for this window.
16
15:8
7:0
Offset 80h-83h
Note:
Alpha Window 3 X Position Register (R/W)
Reset Value: 00000000h
H_TOTAL and H_SYNC_END are values programmed in the GX1 module’s Display Controller Timing registers
(GX_BASE+Memory Offset 8330h[26:19] and 8338h[10:3], respectively). The value of (H_TOTAL – H_SYNC_END) is some-
times referred to as “horizontal back porch”. For more information, see the
GX1 Processor Series Datasheet
.
Note:
Desired screen position should not be outside a video window (F4BAR0+Memory Offset 08h and 0Ch).
31:27
26:16
Reserved.
ALPHA3_X_END (Alpha Window 3 Horizontal End).
Determines the horizontal end position of Alpha Window 3 (not inclu-
sive). This value is calculated according to the following formula:
Value = Desired screen position + (H_TOTAL – H_SYNC_END) – 1.
Reserved.
ALPHA3_X_START (Alpha Window 3 Horizontal Start).
Determines the horizontal start position of Alpha Window 3. This
value is calculated according to the following formula:
Value = Desired screen position + (H_TOTAL – H_SYNC_END) – 2.
15:11
10:0
Offset 84h-87h
Note:
Alpha Window 3 Y Position Register (R/W)
Reset Value: 00000000h
V_TOTAL and V_SYNC_END are values programmed in the GX1 module’s Display Controller Timing registers
(GX_BASE+Memory Offset 8340h[26:16] and 8348h[26:16], respectively). The value of (V_TOTAL – V_SYNC_END) is some-
times referred to as “vertical back porch”. For more information, see the
GX1 Processor Series Datasheet
.
Desired screen position should not be outside a video window (F4BAR0+Memory Offset 08h and 0Ch).
31:27
26:16
Reserved
ALPHA3_Y_END (Alpha Window 3 Vertical End).
Determines the vertical end position of Alpha Window 3 (not inclusive).
This value is calculated according to the following formula:
Value = Desired screen position + (V_TOTAL – V_SYNC_END) + 2.
Reserved
ALPHA3_Y_START (Alpha Window 3 Vertical End).
Determines the vertical start position of Alpha Window 3. This value
is calculated according to the following formula:
Value = Desired screen position + (V_TOTAL – V_SYNC_END) + 1.
15:11
10:0
Offset 88h-8Bh
Alpha Window 3 Color Register (R/W)
Reset Value: 00000000h
31:25
24
Reserved.
ALPHA3_COLOR_REG_EN (Alpha Window 3 Color Register Enable).
Enable bit for the color key matching in Alpha
Window 3.
0: Disable. Where there is a color key match, graphics and video are alpha-blended.
1: Enable. If this bit is enabled and the alpha window is enabled, then where there is a color key match, the color value (in
bits [23:0], ALPHA3_COLOR_REG) is displayed.
ALPHA3_COLOR_REG (Alpha Window 3 Color Register).
Specifies the color to be displayed inside Alpha Window 3
when there is a color key match in the alpha window. This is an RGB value (for RGB blending) or a YUV value (for YUV
blending). In Interlaced YUV blending mode, Y/2 value should be used.
This color is only displayed if the alpha window is enabled and the bit 24 (ALPHA3_COLOR_REG_EN) is enabled.
23:0
Table 6-7. F4BAR0+Memory Offset: Video Processor Configuration Registers (Continued)
Bit
Description
相關PDF資料 |
PDF描述 |
|---|---|
| SC246 | SILICON BIDIRECTIONAL THYRISTORS |
| SC41343DW | Encoder and Decoder Pairs |
| SC41343P | Encoder and Decoder Pairs |
| SC41344DW | Encoder and Decoder Pairs |
| SC41344P | Encoder and Decoder Pairs |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SC2200UFH-266F 33 | 制造商:Advanced Micro Devices 功能描述:AMD Geode Processor |
| SC2203GH | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| SC220-40 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:XpressFlow 2020 Ethernet Routing Switch Chipset |
| SC2204GH | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| SC220-50 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:XpressFlow 2020 Ethernet Routing Switch Chipset |
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