參數(shù)資料
型號： SN74HSTL162822DGGR
廠商： TEXAS INSTRUMENTS INC
元件分類： 鎖存器
英文描述： TTL/H/L SERIES, LOW LEVEL TRIGGERED D LATCH, TRUE OUTPUT, PDSO64
封裝： PLASTIC, TSSOP-64
文件頁數(shù)： 4/9頁
文件大?。?/td> 294K
代理商： SN74HSTL162822DGGR
SN74HSTL162822
14-BIT TO 28-BIT HSTL-TO-LVTTL MEMORY ADDRESS LATCH
SCES091A – DECEMBER 1996 – REVISED APRIL 1997
4
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
PARAMETER MEASUREMENT INFORMATION
th
tsu
LOAD CIRCUIT
Data Input
VREF
1.25 V
0.25 V
VREF
1.25 V
0.25 V
1.25 V
0.25 V
VREF
tw
Input
VOLTAGE WAVEFORMS
SETUP AND HOLD TIMES
VOLTAGE WAVEFORMS
PROPAGATION DELAY TIMES
VOLTAGE WAVEFORMS
PULSE DURATION
tPLH
tPHL
VREF
1.25 V
0.25 V
1.5 V
VOH
VOL
Input
(see Note B)
Output
VREF
From Output
Under Test
CL = 80 pF
(see Note A)
500
LE
NOTES: A. CL includes probe and jig capacitance.
B. All input pulses are supplied by generators having the following characteristics: PRR
≤ 10 MHz, ZO = 50 , tr ≤ 1 ns, tf ≤ 1 ns.
C. The outputs are measured one at a time with one transition per measurement.
D. tPHL and tPLH are the same as tpd.
Figure 1. Load Circuit and Voltage Waveforms
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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