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參數(shù)資料
| 型號： | SSM2518CPZ-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 29/48頁 |
| 文件大小： | 0K |
| 描述： | IC AMP AUD PWR 2C STER D 20LFCSP |
| 標準包裝： | 5,000 |
| 類型： | D 類 |
| 輸出類型： | 2 通道（立體聲） |
| 在某負載時最大輸出功率 x 通道數(shù)量： | 2.5W x 2 @ 4 歐姆 |
| 電源電壓： | 2.5 V ~ 5.5 V |
| 特點： | 消除爆音，數(shù)字輸入，I²C，I²S，靜音，短路和熱保護，關(guān)機，音量控制 |
| 安裝類型： | 表面貼裝 |
| 供應商設(shè)備封裝： | 20-LFCSP-WQ（4x4） |
| 封裝/外殼： | 20-WFQFN 裸露焊盤，CSP |
| 包裝： | 帶卷 (TR) |
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Data Sheet
SSM2518
Rev. A | Page 35 of 48
POWER AND FAULT CONTROL REGISTER
Address: 0x09, Reset: 0x99, Name: Power_Fault_Control
Table 22. Bit Descriptions for Power_Fault_Control
Bits
Bit Name
Settings
Description
Reset
Access
[7:6]
AR_TIME
Automatic Recovery Delay Time. This determines the amount of time
delay between fault detection and an autorecovery attempt.
0x2
RW
00
10 ms autorecovery delay
01
20 ms autorecovery delay
10
40 ms autorecovery delay
11
80 ms autorecovery delay
5
RESERVED
Reserved.
0x0
RW
4
AMP_LPM
Class-D Amplifier Low Power Mode.
0x1
RW
0
High performance operation
1
Low power operation
3
DAC_LPM
DAC Low Power Mode. In low power mode, the DAC runs at half speed.
0x1
RW
0
Normal operation
1
Low power operation
2
R_PWDN
Right Channel Power-Down.
0x0
RW
0
Normal operation
1
Right channel powered down
1
L_PWDN
Left Channel Power-Down.
0x0
RW
0
Normal operation
1
Left channel powered down
0
APWDN_EN
Automatic Power-Down Enable. Automatic power-down automatically
puts the IC in a low power state when 2048 consecutive zero input
samples have been received.
0x1
RW
0
Automatic power-down disabled
1
Automatic power-down enabled
相關(guān)PDF資料 |
PDF描述 |
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