tsu
參數(shù)資料
型號: SSTUB32S868DHLF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 3/20頁
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描述: IC REGIST BUFF 25BIT DDR2 176BGA
產(chǎn)品變化通告: Product Discontinuation 09/Dec/2011
標(biāo)準(zhǔn)包裝: 208
邏輯類型: DDR2 的寄存緩沖器
電源電壓: 1.7 V ~ 1.9 V
位數(shù): 25
安裝類型: 表面貼裝
封裝/外殼: 176-TFBGA
供應(yīng)商設(shè)備封裝: 176-CABGA(6x15)
包裝: 托盤
11
ICSSSTUB32S868D
Advance Information
08/14/06
Register Timing
CK
Dn, DODTn,
DCKEn
RST#
tsu
th
tsu
th
tpdm,tpdmss
CK to Q
CSGEN
CK#
Qn, QODTn,
QCKEn
PAR_IN
nn + 1
n + 2
n + 3
n + 4
tPHL
CK to QERR#
QERR#
tPHL, tPLH
CK to QERR#
tact
H, L, or X
H or L
DCS0#
DCS1#
Data to QERR# Latency
After RESET# is switched from low to high, all data and PAR_IN input signals must be set and held low for a minimum time of tact max,
to avoid false error.
If the data is clocked in on the n clock pulse, the QERR# output sognal will be produced on the n+2 clock pulse and it will be valid on the
n+3 clock pulse.
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參數(shù)描述
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