REV. 4.4.1 2.97V TO 5.5V DUART WITH 16-BYTE FIFO AC ELECTRICAL CHARACTERISTICS TA=0" />
參數(shù)資料
型號(hào)： ST16C2550IJ44-F
廠商： Exar Corporation
文件頁(yè)數(shù)： 20/37頁(yè)
文件大?。?/td> 0K
描述： IC UART FIFO 16B DUAL 44PLCC
標(biāo)準(zhǔn)包裝： 27
特點(diǎn)： *
通道數(shù)： 2，DUART
FIFO's： 16 字節(jié)
規(guī)程： RS232，RS485
電源電壓： 2.97 V ~ 5.5 V
帶故障啟動(dòng)位檢測(cè)功能： 是
帶調(diào)制解調(diào)器控制功能： 是
帶CMOS： 是
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 44-PLCC（16.59x16.59）
包裝： 管件
其它名稱： 1016-1562-5
ST16C2550IJ44-F-ND
ST16C2550
27
REV. 4.4.1
2.97V TO 5.5V DUART WITH 16-BYTE FIFO
AC ELECTRICAL CHARACTERISTICS
TA=0O TO 70OC (-40O TO +85OC FOR INDUSTRIAL GRADE PACKAGE), VCC = 3.3V OR 5.0V (±10%)
70 PF LOAD WHERE APPLICABLE
SYMBOL
PARAMETER
3.3
LIMITS
MIN
MAX
5.0
LIMITS
MIN
MAX
UNIT
COMMENTS
-
Crystal Frequency
20
24
ns
CLK
Clock Pulse Duration
17
8
ns
OSC
External Clock Frequency
30
64
MHz
TAS
Address Setup Time
5
0
ns
TAH
Address Hold Time
10
5
ns
TCS
Chip Select Width
70*
40
ns
* 55ns if VCC =
3.3V +10%/-5% and
TA = 0 to 70oC
(See Figure 12)
TRD
IOR# Strobe Width
70*
40
ns
TDY
Read or Write Cycle Delay
70*
40
ns
TRDV
Data Access Time
35
25
ns
TDD
Data Disable Time
0
25
0
15
ns
TWR
IOW# Strobe Width
40
25
ns
TDS
Data Setup Time
20
15
ns
TDH
Data Hold Time
5
ns
TWDO
Delay From IOW# To Output
50
40
ns
TMOD
Delay To Set Interrupt From
MODEM Input
40
35
ns
TRSI
Delay To Reset Interrupt From IOR#
40
35
ns
TSSI
Delay From Stop To Set Interrupt
1
Bclk
TRRI
Delay From IOR# To Reset Interrupt
45
40
ns
TSI
Delay From Start To Interrupt
45
40
ns
TINT
Delay From Initial INT Reset To
Transmit Start
8
24
8
24
Bclk
TWRI
Delay From IOW# To Reset Inter-
rupt
45
40
ns
TSSR
Delay From Stop To Set RXRDY#
1
Bclk
TRR
Delay From IOR# To Reset
RXRDY#
45
40
ns
TWT
Delay From IOW# To Set TXRDY#
45
40
ns
TSRT
Delay From Center of Start To
Reset TXRDY#
8
Bclk
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PDF描述
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