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參數(shù)資料
| 型號： | ST72652AR4T1/XXX |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, MICROCONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, ROHS COMPLIANT, TQFP-64 |
| 文件頁數(shù)： | 88/161頁 |
| 文件大?。?/td> | 2656K |
| 代理商： | ST72652AR4T1/XXX |
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ST72651AR6
32/161
Doc ID 7215 Rev 4
POWER SUPPLY MANAGEMENT (Cont’d)
6.4.2.1 Switching from Stand-Alone Mode to
USB Mode
In Stand-Alone Mode, when the user plugs in the
USB cable, 4V min. is input to USBVDD. The on-
chip power Supply Manager generates an internal
interrupt when USBVDD reaches USBVIT+ (if the
PLGIE bit in the PCR register is set). The user pro-
gram then can finish the current processing, and
MUST generate a software RESET afterwards.
This puts the microcontroller into reset state and
all I/O ports go into input high impedance mode.
During and after this (software induced) reset
phase, the USBEN pin is set to output low level by
hardware. This causes the USB SWITCH to be
turned ON. Consequently, VDD pin is powered by
Once in USB mode, no power is drawn from the
step-up converter output.
For more details, refer to Figure 24.
Figure 23. External Power Supply Switch
VDD1
USB SWITCH
VDD2
VDDA
USBVDD
USBEN
ST7
(True OD, H/W ctrl)
Step-up converter (Note 3)
4V min. from USB
Note 1: Ground lines not shown
PCR REGISTER
PLG
General Purpose I/O (I/O port DR, DDR)
Option bit
USBEN H/W
CONTROL
USBVIT-
USBVIT+
USBVIT-
PLG bit
USBVDD
Alternate Function (USBEN)
VITPF
USBVIT+
VITMF Bit
VITPF Bit
PLGIE
VITMF
Interrupt Request
RESET
LOGIC
S/W RESET
EDGE DETECTOR
USB VOLTAGE
DETECTOR
WITH LATCH
DETEN
Note 2: Suggested device: STN3PF06 (STMicroelectronics)
VDDF
PLL
REGULATOR
Note 3: To allow USB cable unplug detection, output voltage of step-up converter should be low
enough to not enduce (through PMOS substrate diode) voltage greater than USBVIT-
on USBVDD pin
PMOS
(Note 2)
1
相關(guān)PDF資料 |
PDF描述 |
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| ST7267C8T1/XXX | 16-BIT, MROM, 30 MHz, RISC MICROCONTROLLER, PQFP48 |
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