參數(shù)資料
型號： ST72F324BJ6B6
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDIP42
封裝： 0.600 INCH, SHRINK, PLASTIC, DIP-42
文件頁數(shù)： 62/188頁
文件大?。?/td> 2867K
代理商： ST72F324BJ6B6
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Electrical characteristics
ST72324B
154/188
Figure 70.
Unused I/O pins configured as input(1)
1.
I/O can be left unconnected if it is configured as output (0 or 1) by the software. This has the advantage of
greater EMC robustness and lower cost.
Figure 71.
Typical IPU vs. VDD with VIN = VSS
12.9.2
Output driving current
Subject to general operating conditions for VDD, fCPU, and TA unless otherwise specified.
10k
Unused I/O port
ST7XXX
10k
Unused I/O port
ST7XXX
VDD
0
10
20
30
40
50
60
70
80
90
22 .5
33 .5
4
4 .5
55 .5
6
Vd d (V )
Ip
u
(u
A
)
T a = 1 40° C
Ta = 9 5 ° C
Ta = 2 5 ° C
Ta = -4 5 ° C
Table 106.
Output driving current
Symbol
Parameter
Conditions
Min
Max
Unit
VOL
(1)
Output low level voltage for a standard I/O pin when
8 pins are sunk at same time
VDD =5V
IIO = +5mA
1.2
V
IIO = +2mA
0.5
Output low level voltage for a high sink I/O pin when
4 pins are sunk at same time
IIO = +20mA
TA < 85°
TA >85°C
1.3
1.5
IIO = +8mA
0.6
VOH
(2)
Output high level voltage for an I/O pin when 4 pins
are sourced at same time
IIO = -5mA,
TA < 85°C
TA >85°C
VDD -1.4
VDD -1.6
IIO = -2mA
VDD -0.7
1.
The IIO current sunk must always respect the absolute maximum rating specified in Section 12.2.2 and the sum of IIO (I/O
ports and control pins) must not exceed IVSS.
2.
The IIO current sourced must always respect the absolute maximum rating specified in Section 12.2.2 and the sum of IIO
(I/O ports and control pins) must not exceed IVDD. True open drain I/O pins do not have VOH.
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PDF描述
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