參數(shù)資料
型號： ST72F324BK4T6
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP32
封裝： 7 X 7 MM, PLASTIC, TQFP-32
文件頁數(shù)： 25/188頁
文件大小： 2867K
代理商： ST72F324BK4T6
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On-chip peripherals
ST72324B
120/188
SCI Baud Rate Register (SCIBRR)
SCI Extended Receive Prescaler Division Register (SCIERPR)
This register is used to set the Extended Prescaler rate division factor for the receive circuit.
SCIBRR
Reset value: 0000 0000 (00h)
7
654
32
10
SCP[1:0]
SCT[2:0]
SCR[2:0]
R/W
Table 64.
SCIBRR register description
Bit
Name
Function
7:6 SCP[1:0]
First SCI Prescaler
These 2 prescaling bits allow several standard clock division ranges.
00: PR prescaling factor = 1
01: PR prescaling factor = 3
10: PR prescaling factor = 4
11: PR prescaling factor = 13
5:3
SCT[2:0]
SCI Transmitter rate divisor
These 3 bits, in conjunction with the SCP1 and SCP0 bits, define the total division
applied to the bus clock to yield the transmit rate clock in conventional baud rate
generator mode.
000: TR dividing factor = 1
001: TR dividing factor = 2
010: TR dividing factor = 4
011: TR dividing factor = 8
100: TR dividing factor = 16
101: TR dividing factor = 32
110: TR dividing factor = 64
111: TR dividing factor = 128
2:0 SCR[2:0]
SCI Receiver rate divisor
These 3 bits, in conjunction with the SCP[1:0] bits, define the total division applied
to the bus clock to yield the receive rate clock in conventional baud rate generator
mode.
000: RR dividing factor = 1
001: RR dividing factor = 2
010: RR dividing factor = 4
011: RR dividing factor = 8
100: RR dividing factor = 16
101: RR dividing factor = 32
110: RR dividing factor = 64
111: RR dividing factor = 128
SCIERPR
Reset value: 0000 0000 (00h)
7
654
32
10
ERPR[7:0]
R/W
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PDF描述
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