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參數(shù)資料
| 型號： | SY100EL34LZC TR |
| 廠商： | Micrel Inc |
| 文件頁數(shù)： | 6/7頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GEN /2/4/6 5V/3.3V 16SOIC |
| 標準包裝： | 1,000 |
| 系列： | 100EL, Precision Edge® |
| 類型： | 時鐘發(fā)生器 |
| PLL： | 無 |
| 輸入： | ECL，PECL |
| 輸出： | 時鐘 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:3 |
| 差分 - 輸入:輸出： | 是/是 |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-SOIC（0.154"，3.90mm 寬） |
| 供應商設備封裝： | 16-SOIC |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | SY100EL34LZCTR SY100EL34LZCTR-ND |
Micrel, Inc.
Precision Edge
SY10EL34/L
SY100EL34/L
December 2011
7
M9999-120611-I
hbwhelp@micrel.com or (408) 955-1690
Timing Diagram
The EN signal will freeze the internal clocks to the flip-flops on the first falling edge of CLK after its assertion. The internal
dividers will maintain their state during the internal clock freeze and will return to clocking once the internal clocks are
unfrozen. The outputs will transition to their next states in the same manner, time and relationship as they would have had
the EN signal not been asserted.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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