參數(shù)資料
型號(hào)： SY100EP15VK4ITR
廠商： MICREL INC
元件分類： 時(shí)鐘及定時(shí)
英文描述： 3.3V / 5V 2.5GHz PECL/ECL 1:4 FANOUT BUFFER WITH 2:1 INPUT MUX
中文描述： 100E SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
封裝： TSSOP-16
文件頁數(shù)： 8/9頁
文件大?。?/td> 110K
代理商： SY100EP15VK4ITR
8
ECL Pro
SY100EP15V
Micrel, Inc.
M9999-120505
hbwhelp@micrel.com or (408) 955-1690
TERMINATION RECOMMENDATIONS
R2
82
R2
82
Z
O
= 50
Z
O
= 50
+3.3V
+3.3V
V
t
= V
CC
–2V
R1
130
R1
130
+3.3V
Figure 1. Parallel Termination–Thevenin Equivalent
Notes:
1. For +2.5V systems: R1 = 250
, R2 = 62.5
.
2. For +5.0V systems: R1 = 82
, R2 = 130
.
Z
= 50
Z
= 50
50
50
50
+3.3V
+3.3V
“source”
“destination”
(Optional)
C1
0.01
μ
F
R
b
Figure 2. Three-Resistor “Y–Termination”
Notes:
1. Power-saving alternative to Thevenin termination.
2. Place termination resistors as close to destination inputs as possible.
3. R
b
resistor sets the DC bias voltage, equal to V
T
. For +3.3V systems R
b
= 46
to 50
. For +5V systems, R
b
= 110
.
4. C1 is an optional bypass capacitor intended to compensate for any tr/tf mismatches.
+3.3V
+3.3V
50
Z
O
= 50
0.01
μ
F
V
BB
R2
82
+3.3V
+3.3V
R1
130
R1
130
R2
82
V
t
= V
CC
–2V
Q
/Q
+3.3V
Figure 3. Terminating Unused I/O
Notes
1. Unused output (/Q) must be terminated to balance the output.
2. Micrel’s differential I/O logic devices include a V
BB
reference pin .
3. Connect unused input through 50
to V
BB
. Bypass with a 0.01
μ
F capacitor to V
CC
, not GND.
4. For +2.5V systems: R1 = 250
, R2 = 62.5
.
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PDF描述
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