Contents
v
October 2004
SLES123
6.5
System Control Register 2 (0x04)
64
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6.6
Channel Configuration Control Register (0x05X0C)
64
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6.7
Headphone Configuration Control Register (0x0D)
65
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6.8
Serial Data Interface Control Register (0x0E)
65
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6.9
Soft Mute Register (0x0F)
66
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6.10
Automute Control Register(0x14)
66
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6.11
Automute PWM Threshold and Backend Reset Period (0x15)
67
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6.12
Modulation Index Limit Register (0x16)
68
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6.13
Interchannel Channel Delay Registers (0x1B 0x22) and Offset Register (0x23)
68
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6.14
Bank Switching Command (0x40)
69
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6.15
Input Mixer Registers (0x41, 0x42, 0x47, 0x48, Channels 14)
70
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6.16
Bass Management Registers (0x49–0x50)
72
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6.17
Biquad Filters Register (0x51 – 0x88)
72
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6.18
Bass and Treble Bypass Register (0x89 – 0x90, Channels 1 4)
73
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6.19
Loudness Registers (0x91 – 0x95)
73
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6.20
DRC1 Control (0x96, Channels 13)
74
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6.21
DRC2 Control (0x97, Channel 4)
74
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6.22
DRC1 Data Registers (0x98 – 0x9C)
75
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6.23
DRC2 Data Registers (0x9D – 0xA1)
76
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6.24
DRC Bypass Registers (0xA2, 0xA3, 0xA8, 0xA9)
77
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6.25
4x2 Output Mixer Registers (0xAA and 0xAB)
77
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6.26
4x3 Output Mixer Registers (0xB0 – 0xB1)
78
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
6.27
Volume Biquad Register (0xCF)
80
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6.28
Volume Treble and Bass Slew Rates (0xD0)
80
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6.29
Volume Registers (0xD1, 0xD2, 0xD7, and 0xD8)
80
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
6.30
Bass Filter Set Register (0xDA)
81
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6.31
Bass Filter Index Register (0xDB)
82
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6.32
Treble Filter Set Register (0xDC)
83
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6.33
Treble Filter Index (0xDD)
84
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6.34
AM Mode Register (0xDE)
84
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6.35
PSVC Range Register (0xDF)
85
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6.36
General Control Register (0xE0)
85
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6.37
Incremental Multiple Write Append Register (0xFE)
85
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7
TAS5504 Example Application Schematic
87
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