參數(shù)資料
型號： TDA7333
廠商： 意法半導(dǎo)體
英文描述： RDS/RBDS PROCESSOR
中文描述： 鐵路發(fā)展策略/無線廣播數(shù)據(jù)處理器
文件頁數(shù)： 14/21頁
文件大小： 656K
代理商： TDA7333
TDA7333
14/21
(3) select sensitivity of quality bit.
00: minimum (reset value)
11: maximum
Note :
Sinc4reg and testreg are reserved registers dedicated to testing and evaluation.
select PLL’s time constants by software or hardware:
1: software. Time constants are selected by pllb[1:0] resp.
pllf
0: hardware. (reset value) Time constants automatically
increase after a reset.
set the 57kHz pll time constant (1)
bit 0 of 1187.5Hz pll time constant (2)
bit 1 of 1187.5Hz pll time constant (2)
bit 0 of quality sensitivity (3)
bit 1 of quality sensitivity (3)
select oscillator frequency:
1: 8.664MHz
0: 8.55MHz (reset value)
bt name
access
bt 7
bt 0
bt 1
bt 2
bt 3
bt 4
bt 5
bt 6
r
r/w
r/w
r/w
r/w
r/w
r/w
r/w
shw
-
plb1
freq
qsens0
qsens1
plb0
plf
plb1
1
0
0
0
plb0
1
0
1
1
(2)
lock time needed for 90 deg devation
5 ms (reset status)
15 ms
35 ms
76 ms
rese vaue
1
0
0
0
0
0
0
0
plf
(1)
0
1
lock time needed for 90 deg devation
2 ms
10 ms
rds_bd_ctrl
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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