參數(shù)資料
型號(hào)： TDA8753A
廠商： NXP SEMICONDUCTORS
元件分類(lèi)： 模擬信號(hào)調(diào)理
英文描述： YUV 8-bit analog-to-digital interface
中文描述： SPECIALTY ANALOG CIRCUIT, PDIP42
封裝： 0.600 INCH, PLASTIC, SOT-270-1, SDIP-42
文件頁(yè)數(shù)： 8/20頁(yè)
文件大小： 111K
代理商： TDA8753A
1996 Jan 12
8
Philips Semiconductors
Product specification
YUV 8-bit analog-to-digital interface
TDA8753A
Clamp and references [I
ref
, DEC
ref(L)
and V
ref(H)
]
A
CL
clamping accuracy
Y
U and V
4
1
10
22
420
+1
+1
LSB
LSB
nF
C
clamp
Z
ADC
serial clamp capacitor
internal impedance between
pin 29 and V
SSA
converter reference HIGH, applied
to pin 29
converter reference voltage LOW,
applied to pin 28
V
ref(H)
2.38
V
V
DECref(L)
V
ref(H)
= 2.38 V
0.39
V
Y analog input (INY); V
ref(H)
= 2.38 V, V
ref(L)
= 0.39 V;
see Table 4
V
i(p-p)
input voltage, full range
(peak-to-peak value)
input current
input capacitance
ramp input
1.26
V
I
i
C
I
clamp non-active
5
100
15
nA
pF
U,V analog inputs (INU and INV); V
ref(H)
= 2.38 V, V
ref(L)
= 0.39 V;
see Table 4
V
i(p-p)
I
i
C
I
input voltage (peak-to-peak value) ramp input
input current
input capacitance
1.26
5
100
15
V
nA
pF
clamp non-active
Inputs isolation
α
act
crosstalk between INY, INU and
INV
50
dB
Digital outputs (Y0 to Y7, U1, U0, V1 and V0);
see Table 3
V
OL
V
OH
LOW level output voltage
HIGH level output voltage
I
OL
= 1.6 mA
I
OH
= 0.4 mA
0
2.4
0.5
V
DDD
V
V
Analog signal processing (f
CLK
= 20 MHz)
G
diff
Φ
diff
f
all
differential gain
differential phase
harmonics (full scale) all
components
note 2
note 2
note 3; Y
U and V
note 4
1 dB; note 5
1.5
1.0
53
55
2
6
%
deg
dB
dB
%/V
MHz
SVR
B
supply voltage ripple rejection
bandwidth
Transfer function (f
clk
= 16 MHz)
INL
DNL
integral non-linearity
differential non-linearity
ramp input
ramp input; Y
ramp input; U and V
note 6; Y
U and V
±
0.75
±
0.5
±
0.6
44.5
46
±
0.75
±
0.9
LSB
LSB
LSB
dB
dB
SNR
signal-to-noise ratio without
harmonics
41
42
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
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