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參數(shù)資料
| 型號： | TLC32041CFN |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | ANALOG INTERFACE CIRCUITS |
| 中文描述： | 模擬接口電路 |
| 文件頁數(shù)： | 24/33頁 |
| 文件大?。?/td> | 453K |
| 代理商： | TLC32041CFN |
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TLC32040C, TLC32040I, TLC32041C, TLC32041I
ANALOG INTERFACE CIRCUITS
SLAS014E – SEPTEMBER 1987 – REVISED MAY 1995
24
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
serial port – AIC output signals
TEST CONDITIONS
MIN
TYP
MAX
UNIT
tc(SCLK)
tf(SCLK)
tr(SCLK)
Shift clock (SCLK) cycle time
380
ns
Shift clock (SCLK) fall time
50
ns
Shift clock (SCLK) rise time
50
ns
Shift clock (SCLK) duty cycle
Delay from SCLK
↑
to FSR/FSX
↓
Delay from SCLK
↑
to FSR/FSX
↑
DR valid after SCLK
↑
Delay from SCLK
↑
to EODX/EODR
↓
in word mode
Delay from SCLK
↑
to EODX/EODR
↑
in word mode
EODX fall time
45
55
%
td(CH-FL)
td(CH-FH)
td(CH-DR)
td(CH-EL)
td(CH-EH)
tf(EODX)
tf(EODR)
td(CH-EL)
td(CH-EH)
td(MH-SL)
td(MH-SH)
Typical values are at TA = 25
°
C.
CL = 50 pF
CL = 50 pF
52
ns
52
ns
90
ns
90
ns
90
ns
15
ns
EODR fall time
Delay from SCLK
↑
to EODX/EODR
↓
in byte mode
Delay from SCLK
↑
to EODX/EODR
↑
in byte mode
Delay from MSTR CLK
↑
to SCLK
↓
Delay from MSTR CLK
↑
to SCLK
↑
15
ns
100
ns
100
ns
65
ns
65
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TLC32041I | ANALOG INTERFACE CIRCUITS |
| TLC32040M | ANALOG INTERFACE CIRCUIT |
| TLC32040MFK | ANALOG INTERFACE CIRCUIT |
| TLC32040MJ | ANALOG INTERFACE CIRCUIT |
| TLC32044C | VOICE-BAND ANALOG INTERFACE CIRCUITS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TLC32041CN | 制造商:TI 功能描述:32041 |
| TLC32041I | 制造商:TI 制造商全稱:Texas Instruments 功能描述:ANALOG INTERFACE CIRCUITS |
| TLC32041IN | 制造商:TI 制造商全稱:Texas Instruments 功能描述:ANALOG INTERFACE CIRCUITS |
| TLC32042EFN | 制造商:Rochester Electronics LLC 功能描述: |
| TLC32044 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:VOICE-BAND ANALOG INTERFACE CIRCUITS |
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