參數(shù)資料
型號(hào)： TLV571PW
廠商： Texas Instruments, Inc.
英文描述： 2.7 V TO 5.5 V, 1-CHANNEL, 8-BIT, PARALLEL ANALOG-TO-DIGITAL CONVERTER
中文描述： 2.7 V至5.5 V，1通道，8位并行模擬到數(shù)字轉(zhuǎn)換器
文件頁數(shù)： 10/27頁
文件大小： 405K
代理商： TLV571PW
T
2
R
S
1
P
software START conversion
external clock
With CS low and WR low, data is written into the ADC. Sampling begins at the rising edge of WR. The conversion process begins 6 clocks
after sampling begins. At the end of conversion, the INT goes low telling the host that conversion is ready to be read out. EOC B low during
the conversion. The external clock is active and used as the reference at all times. With this mode, WR and RD should not be applied at the
rising edge of the clock (see Figure 3).
Auto Powerdown
CLK
CS
WR
RD
D[0:7]
INT
EOC
Config
Data
ADC Data
ADC Data
tsu(CSL_WRL)
th(WRH_CSH)
tsu(DAV_WRH)
th(WRH_DAV)
tc
tsu(CSL_RDL)
th(RDH_CSH)
ten(RDL_DAV)
tdis(RDH_DAV)
tc
t
ten(RDL_DAV)
0
1
5
6
7
15
16
OR
su(CSL_RDL)
t(sample)
t(sample)
0
4
5
15
Figure 6. Input Conversion – Software Start, External Clock
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