參數(shù)資料
型號: TMP86FS49AUG
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP64
封裝: 10 X 10 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-64
文件頁數(shù): 269/277頁
文件大?。?/td> 2632K
代理商: TMP86FS49AUG
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ATmega165A/PA/325A/PA/3250A/PA/645A/P/6450A/P [DATASHEET]
8285E–AVR–02/2013
rect PWM mode is shown on Figure 15-7. The TCNT0 value is in the timing diagram shown as a histogram for
illustrating the dual-slope operation. The diagram includes non-inverted and inverted PWM outputs. The small hor-
izontal line marks on the TCNT0 slopes represent compare matches between OCR0A and TCNT0.
Figure 15-7. Phase Correct PWM Mode, timing diagram.
The Timer/Counter Overflow Flag (TOV0) is set each time the counter reaches BOTTOM. The Interrupt Flag can
be used to generate an interrupt each time the counter reaches the BOTTOM value.
In phase correct PWM mode, the compare unit allows generation of PWM waveforms on the OC0A pin. Setting the
COM0A1:0 bits to two will produce a non-inverted PWM. An inverted PWM output can be generated by setting the
COM0A1:0 to three (See Table 15-5 on page 94). The actual OC0A value will only be visible on the port pin if the
data direction for the port pin is set as output. The PWM waveform is generated by clearing (or setting) the OC0A
Register at the compare match between OCR0A and TCNT0 when the counter increments, and setting (or clear-
ing) the OC0A Register at compare match between OCR0A and TCNT0 when the counter decrements. The PWM
frequency for the output when using phase correct PWM can be calculated by the following equation:
The N variable represents the prescale factor (1, 8, 64, 256, or 1024).
The extreme values for the OCR0A Register represent special cases when generating a PWM waveform output in
the phase correct PWM mode. If the OCR0A is set equal to BOTTOM, the output will be continuously low and if set
equal to MAX the output will be continuously high for non-inverted PWM mode. For inverted PWM the output will
have the opposite logic values.
At the very start of period 2 in Figure 15-7 OCn has a transition from high to low even though there is no Compare
Match. The point of this transition is to guarantee symmetry around BOTTOM. There are two cases that give a
transition without Compare Match.
OCR0A changes its value from MAX, like in Figure 15-7. When the OCR0A value is MAX the OCn pin value is the
same as the result of a down-counting Compare Match. To ensure symmetry around BOTTOM the OCn value at
MAX must correspond to the result of an up-counting Compare Match
The timer starts counting from a value higher than the one in OCR0A, and for that reason misses the Compare
Match and hence the OCn change that would have happened on the way up
TOVn Interrupt Flag Set
OCnx Interrupt Flag Set
1
2
3
TCNTn
Period
OCn
(COMnx1:0 = 2)
(COMnx1:0 = 3)
OCRnx Update
f
OCnxPCPWM
fclk_I/O
N 510
------------------
=
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PDF描述
TMP86FS64FG 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP100
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參數(shù)描述
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TMP86FS49BFG 制造商:TOSHIBA 制造商全稱:Toshiba Semiconductor 功能描述:8 Bit Microcontroller
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TMP86FS49BFG(ZHZ) 功能描述:8位微控制器 -MCU INTEGRATED CIRCUIT MICROCONTROLLER TLCS870C RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT