參數(shù)資料
型號(hào)： TMP90CH02
廠商： Toshiba Corporation
元件分類： 通用總線功能
英文描述： High Speed Advanced CMOS 8-bit Microcontroller,Integrating 8-Bit CPU,RAM，ROM，General Serial Interface,Timer/Event Counter(高速、先進(jìn)的 CMOS 8位微控制器（芯片集成了8位CPU,ROM，RAM，通用串行接口，定時(shí)器/事件計(jì)數(shù)器）)
中文描述： 采用先進(jìn)的CMOS高速8位微控制器，集成8位CPU，內(nèi)存，光盤(pán)，通用串行接口，定時(shí)器/事件計(jì)數(shù)器（高速，先進(jìn)的的CMOS 8位微控制器（芯片集成了8位的CPU，ROM和RAM內(nèi)存，通用串行接口，定時(shí)器/事件計(jì)數(shù)器））
文件頁(yè)數(shù)： 10/12頁(yè)
文件大小： 343K
代理商： TMP90CH02
10/12
TOSHIBA CORPORATION
TMP90CH02/H03
4.5 Zero-Cross Characteristics
V
CC
= 5V
±
10% TA = -40 ~ 85
°
C (1 ~ 10MHz)
TA = -20 ~ 70
°
C (1 ~ 16MHz)
Symbol
Parameter
Condition
Min
Max
Unit
V
ZX
A
ZX
F
ZX
Zero-cross detection input
AC coupling C = 0.1
μ
F
50/60Hz sine wave
1
1.8
VAC p - p
Zero-cross accuracy
–
135
mV
Zero-cross detection input frequency
–
0.04
1
kHz
4.6 Serial Channel Timing-I/O Interface Mode
V
CC
= 5V
±
10% TA = -40 ~ 85
°
C (1 ~ 10MHz)
CL = 50pF TA = -20 ~ 70
°
C (1 ~ 16MHz)
Symbol
Parameter
Variable
12.5MHz Clock
16MHz Clock
Unit
Min
Max
Min
Max
Min
Max
t
SCY
t
OSS
t
OHS
t
HSR
t
SRD
Serial Port Clock Cycle Time
8x
–
640
–
500
–
ns
Output Data Setup SCLK Rising Edge
6x - 150
–
320
–
225
–
ns
Output Data Hold After SCLK Rising Edge
2x - 120
–
120
–
45
–
ns
Input Data Hold After SCLK Rising Edge
0
–
0
–
0
–
ns
SCLK Rising Edge to Input DATA Valid
–
6x - 150
–
450
–
225
ns
4.7 8-bit Event Counter
V
CC
= 5V
±
10% TA = -40 ~ 85
°
C (1 ~ 10MHz)
TA = -20 ~ 70
°
C (1 ~ 16MHz)
Symbol
Parameter
Variable
12.5MHz Clock
16MHz Clock
Unit
Min
Max
Min
Max
Min
Max
t
VCK
t
VCKL
t
VCKH
TI2 clock cycle
8x + 100
–
740
–
600
–
ns
TI2 Low clock pulse width
4x + 40
–
360
–
290
–
ns
TI2 High clock pulse width
4x + 40
–
360
–
290
–
ns
4.8 Interrupt Operation
V
CC
= 5V
±
10% TA = -40 ~ 85
°
C (1 ~ 10MHz)
TA = -20 ~ 70
°
C (1 ~ 16MHz)
Symbol
Parameter
Variable
12.5MHz Clock
12.5MHz Clock
Unit
Min
Max
Min
Max
Min
Max
t
INTAL
NMI, INT0 Low level pulse width
4x
–
320
–
250
–
ns
t
INTAH
NMI, INT0 High level pulse width
4x
–
320
–
250
–
ns
t
INTBL
INT1, INT2 Low level pulse width
8x + 100
–
740
–
600
–
ns
t
INTBH
INT1, INT2 High level pulse width
8x + 100
–
740
–
600
–
ns
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PDF描述
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