參數(shù)資料
型號(hào)： TMP90CH03
廠商： Toshiba Corporation
元件分類： 通用總線功能
英文描述： High Speed Advanced CMOS 8-bit Microcontroller,Integrating 8-Bit CPU,RAM，ROM，General Serial Interface,Timer/Event Counter(高速、先進(jìn)的 CMOS 8位微控制器（芯片集成了8位CPU,ROM，RAM，通用串行接口，定時(shí)器/事件計(jì)數(shù)器）)
中文描述： 采用先進(jìn)的CMOS高速8位微控制器，集成8位CPU，內(nèi)存，光盤，通用串行接口，定時(shí)器/事件計(jì)數(shù)器（高速，先進(jìn)的的CMOS 8位微控制器（芯片集成了8位的CPU，ROM和RAM內(nèi)存，通用串行接口，定時(shí)器/事件計(jì)數(shù)器））
文件頁數(shù)： 8/12頁
文件大?。?/td> 343K
代理商： TMP90CH03
8/12
TOSHIBA CORPORATION
TMP90CH02/H03
AC output level High 2.2V/Low 0.8V
AC input level High 2.4V/Low 0.45V (D0 ~ D7)
High 0.8V
CC
/Low 0.2V
CC
(excluding D0 ~ D7)
4.3 AC Characteristics
V
CL = 50pF TA = -20 ~ 70
CC
= 5V
±
10% TA = -40 ~ 85
°
C (1 ~ 10MHz)
C (1 ~ 16MHz)
°
Symbol
Parameter
Variable
12.5MHz Clock
16MHz Clock
Unit
Min
Max
Min
Max
Min
Max
t
OSC
t
CYC
t
WL
t
WH
t
AC
t
RR
t
CA
t
AD
t
RD
t
HR
t
WW
t
DW
t
WD
t
CWA
t
AWA
t
WAS
t
WAH
t
RV
t
CPW
t
PRC
t
CPR
t
CHCL
t
CLC
t
CLHA
t
ACL
t
CLD
OSC. Period = x
62.5
1000
80
–
62.5
–
ns
CLK Period
4x
4x
320
–
250
–
ns
CLK Low width
2x - 40
–
120
–
85
–
ns
CLK High width
2x - 40
–
120
–
85
–
ns
Address Setup to RD, WR
x - 45
–
35
–
18
–
ns
RD Low width
2.5x - 40
–
160
–
117
–
ns
Address Hold Time After RD, WR
0.5x - 20
–
20
–
12
–
ns
Address to Valid Data In
–
3.5x - 95
–
185
–
123
ns
RD to Valid Data In
–
2.5x - 80
–
120
–
76
ns
Input Data Hold After RD
0
–
0
–
0
–
ns
WR Low width
2.5x - 40
–
160
–
117
–
ns
Data Setup to WR
2x - 50
–
110
–
75
–
ns
Data Hold After WR
20
70
20
70
20
70
ns
RD, WR to Valid WAIT
–
1.5x - 100
–
20
–
13
ns
Address to Valid WAIT
–
2.5x - 130
–
70
–
26
ns
WAIT Setup to CLK
50
–
50
–
50
–
ns
WAIT Hold After CLK
0
–
0
–
0
–
ns
RD/WR Recovery Time
1.5x - 35
–
85
–
59
–
ns
CLK to Port Data Output
–
x + 200
–
280
–
262
ns
Port Data Setup to CLK
200
–
200
–
200
–
ns
Port Data Hold After CLK
100
–
100
–
100
–
ns
RD/WR Hold After CLK
x - 40
–
40
–
23
–
ns
RD/WR Setup to CLK
1.5x - 25
–
95
–
69
–
ns
Address Hold After CLK
1.5x - 80
–
40
–
14
–
ns
Address Setup to CLK
2.5x - 80
–
120
–
77
–
ns
Data Setup to CLK
x - 50
–
30
–
13
–
ns
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PDF描述
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