參數(shù)資料
型號： TMS320DM642ZDK600
廠商： Texas Instruments, Inc.
英文描述： Adjustable 2.5-36V +/-2.2% Tolerance, 1-100mA Shunt Regulator; Package: TO-92 (TO-226) 5.33mm Body Height; No of Pins: 3; Container: Fan-Fold; Qty per Container: 2000
中文描述： 視頻/影像定點數(shù)字信號處理器
文件頁數(shù)： 93/123頁
文件大?。?/td> 1205K
代理商： TMS320DM642ZDK600
www.ti.com
OSCCLK
SYSCLKOUT
Write to PLLCR
OSCCLK * 2
(Current CPU
Frequency)
OSCCLK/2
(CPU Frequency While PLL is Stabilizing
With the Desired Frequency. This Period
(PLL Lock-up Time, t
p
) is
131072 OSCCLK Cycles Long.)
OSCCLK * 4
(Changed CPU Frequency)
6.8
General-Purpose Input/Output (GPIO)
6.8.1
GPIO - Output Timing
GPIO
t
r(GPO)
t
f(GPO)
TMS320F2808, TMS320F2806
TMS320F2801, UCD9501
Digital Signal Processors
SPRS230F–OCTOBER 2003–REVISED SEPTEMBER 2005
Figure 6-7. Example of Effect of Writing Into PLLCR Register
Table 6-12. General-Purpose Output Switching Characteristics
PARAMETER
MIN
MAX
UNIT
ns
ns
MHz
t
r(GPO)
t
f(GPO)
t
fGPO
Rise time, GPIO switching low to high
Fall time, GPIO switching high to low
Toggling frequency, GPO pins
All GPIOs
All GPIOs
8
8
25
Figure 6-8. General-Purpose Output Timing
Electrical Specifications
93
相關(guān)PDF資料
PDF描述
TMS320DM642ZNZ500 Video/Imaging Fixed-Point Digital Signal Processor
TMS320DM642ZNZ600 Adjustable 2.5-36V +/-2.2% Tolerance, 1-100mA Shunt Regulator; Package: 8 LEAD PDIP; No of Pins: 8; Container: Rail; Qty per Container: 50
TMS320E14 DIGITAL SIGNAL PROCESSORS
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TMS320E15-25 200mA, 40kHz PWM Control Circuit with 6.4V UVLO Threshold and 48% Max Duty Cycle; Package: SOIC 16 LEAD; No of Pins: 16; Container: Rail; Qty per Container: 48
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參數(shù)描述
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