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參數(shù)資料
| 型號： | TP6508 |
| 英文描述： | Pushbutton Switch; Actuator Diameter:0.078"; Circuitry:6PDT; Switch Operation:6 Changeover Push-Push; Contact Current Max:100mA; Leaded Process Compatible:Yes; Mounting Type:PCB; Switch Function:6PDT |
| 中文描述： | 顯卡 |
| 文件頁數(shù)： | 70/134頁 |
| 文件大小： | 600K |
| 代理商： | TP6508 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁當前第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁
P.67
Panel Control Register Description
The following registers are TP6508 Panel Control registers. These registers are accessed by
first writing the index of the desired register to the Sequencer Index register, i.e. address Hex 3D4 and
then accessing the register using the address Hex 3D5. These registers are protected by password/
Identification register (Extended Index Register Hex 05) .
Extended Indexed Register CREG A0 : Panel Miscellaneous Control Register 1
This is a read/write register.
Port address is Hex 3D5.
Default value after hardware reset is Hex 00.
D0-2 Flat panel type 0 to 2
D3
Invert LP/PHSYNC control
D4
Invert FLM/PVSYNC control
D5
invert FPVDCLK/PSCLK
D6
Free run LLCLK
D7
Invert DEN control
Bit 0-2
These three bits select the type of Flat panel connected.
Bit 1
Bit 0
0
0
0
1
1
0
1
1
0
0
0
1
1
0
1
1
A logical 1 would invert the LLCLK signal (normally active high).
A logical 1 would invert the LFS signal (normally active high).
A logical 1 would invert the FPVDCLK signal (normally active high).
The last line of every frame may display longer and brighter than other lines. When this bit is a logical
1 , it forces TP6508 to generate a free-running LLCLK and eliminates the brighter line during CRT
blanking cycle.
A logical 1 would invert the DEN signal (normally active high) for PLASMA or TFT panel display
mode .
Bit 2
0
0
0
0
1
1
1
1
Panel type
Dual-Scan/Dual-data Monochrome LCD panels
Gray scale PLASMA panels
Single-Scan STN color LCD panels
TFT color LCD panels
Reserved
Gray scale EL panels
Dual-Scan STN color LCD panels
Reserved
Bit 3
Bit 4
Bit 5
Bit 6
Bit 7
Extended Indexed Register CREG A1 : Panel Miscellaneous Control Register 2
This is a read/write register.
Port address is Hex 3D5.
Default value after hardware reset is Hex 00.
D0
D1
D2
D3
D4
D5
Select 8 bits color STN interface
Select enhance color STN timing
Select CRT-like LP and FLM for TFT LCD panel
Disable CRT display
Enable Flat panel interface
Select 8 bit PLASMA panel interface
相關PDF資料 |
PDF描述 |
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