參數(shù)資料
型號(hào)： TSXPC750AMG8LE
英文描述： Microprocessor
中文描述： 微處理器
文件頁數(shù)： 27/44頁
文件大小： 870K
代理商： TSXPC750AMG8LE
27
TSPC750A/740A
2128A–HIREL–01/02
L2BusInputAC
Specifications
TheL2businputinterfaceACtimingspecificationsarefoundinTable13.
Notes:
1. AllinputspecificationsaremeasuredfromtheTTLlevel(0.8Vor2.0V)ofthesignalinquestiontothemidpointvoltageofthe
risingedgeoftheinputL2SYNC_IN.Inputtimingsaremeasuredatthepins(see
Figure15).
2. RiseandfalltimesfortheL2SYNC_INinputaremeasuredfrom0.4to2.4V.
L2BusOutputAC
Specifications
Table14providestheL2busoutputinterfaceACtimingspecificationsforthe
TSPC750AasdefinedinFigure16.
Notes:
1. AlloutputsaremeasuredfromthemidpointvoltageoftherisingedgeofL2SYNC_INtotheTTLlevel(0.8Vor2.0V)ofthe
signalinquestion.Theoutputtimingsaremeasuredatthepins.
2. Theoutputsarevalidforbothsingle-endedanddifferentialL2CLKmodes.Forflow-THRUandpipelinedreg-regsynchro-
nousburstRAMs,L2CR[14-15]=00isrecommended.Forpipelineddelay-writesynchronousburstSRAMs,L2CR[14-15]=
01isrecommended.
3. AllmaximumtimingspecificationsassumeC
L
=20pF.
4. ThismeasurementassumesC
L
=5pF.
5. Reservedforfutureuse.
Table13.
L2BusInputInterfaceACTimingSpecifications,seenote
(1)
V
DD
=AV
DD
=L2AV
DD
=2.6V
DC
±
100mV,OV
DD
=L2OV
DD
=3.3±
5%V
DC
,GND=0V
DC
,
-55
≤
T
j
<125
°
C
Num
Characteristic
ProcessorFrequency
200-266MHz
Unit
Notes
Min
Max
29,30
L2SYNC_INriseandfalltime
-
1.0
ns
2
24
DataandparityinputsetuptoL2SYNC_IN
2.0
-
ns
25
L2SYNC_INtodataandparityinputhold
0.5
_
ns
Table14.
L2BusOutputInterfaceACTimingSpecificationsseenote
(1)
V
DD
=AV
=L2AV
DD
=2.6V
DC
±
100mV,OV
DD
=L2OV
DD
=3.3±5%V
DC
,GND=0V
DC
,
-55
≤
T
j
<125
°
C,CL = 20 pF
seenote
(3)
Num
Characteristic
L2CR[14-15]isequivalentto:
Unit
Notes
00
(2)
01
10
11
Min
Max
Min
Max
Min
Max
Min
Max
26
L2SYNC_INtooutputvalid
-
5.0
-
5.5
-
5.7
-
6
ns
27
L2SYNC_INtooutputhold
0.5
-
1.0
-
1,2
-
1,5
-
ns
4
28
L2SYNC_INtohighimpedance
-
4.0
-
4.5
-
4.7
-
5
ns
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