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參數(shù)資料
| 型號(hào)： | UPD16661AN-051 |
| 廠商： | NEC Corp. |
| 英文描述： | 160-OUTPUT LCD COLUMN SEGMENT DRIVER WITH RAM |
| 中文描述： | 160輸出LCD列段驅(qū)動(dòng)與RAM |
| 文件頁數(shù)： | 17/36頁 |
| 文件大?。?/td> | 187K |
| 代理商： | UPD16661AN-051 |
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17
μ
PD16661A
9. LIQUID-CRYSTAL TIMING GENERATION
9.1 Reset state
In the reset state, the internal counter is zero-cleared.
After the reset is released, the display OFF function operates during the 4-frame cycle, even if the /DOFF pin is
at H.
9.2 Liquid-crystal timing generation circuit
When the master mode is set with MS = H, this circuit generates the signals /FRM and STB at a duty ratio timing
of 1/240. It also generates L1 and L2, which are the drive voltage selection signals for the row driver.
The /FRM signal is generated twice per frame. The STB signal is generated 121 times per half frame, or 242
times per frame.
Generation of /FRM & STB signals
Generation of L1 and L2 signals
STB
1 2 3 4
1 2 3 4
1 2 3 4
1 2 3 4
L1
1 1 1 1
1 1 1 1
0 0 0 0
0 0 0 0
L2
1 0 1 0
0 1 0 1
0 1 0 1
1 0 1 0
/RESET
/FRM
/DOUT
Internal state
Display OFF
Display ON
1
2
3
4
5
6
OSC1
/FRM
STB
121
1
121
Frame
1
121
1
2
2
2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD16661AN | 160-OUTPUT LCD COLUMN SEGMENT DRIVER WITH RAM |
| UPD16661A | 160-OUTPUT LCD COLUMN SEGMENT DRIVER WITH RAM |
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| UPD16675A | 1/34, 1/36 DUTY LCD CONTROLLER/DRIVER |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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